[发明专利]基于逻辑保护射极耦合激发式逻辑电路的滤波控制系统在审

专利信息
申请号: 201510324162.5 申请日: 2015-06-12
公开(公告)号: CN104968086A 公开(公告)日: 2015-10-07
发明(设计)人: 黄涛 申请(专利权)人: 成都雷克尔科技有限公司
主分类号: H05B37/02 分类号: H05B37/02
代理公司: 暂无信息 代理人: 暂无信息
地址: 610000 四川省成都*** 国省代码: 四川;51
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摘要: 发明公开了基于逻辑保护射极耦合激发式逻辑电路的滤波控制系统,主要由场效应管MOS,非门IC1,非门IC3,非门IC4,非门IC2,滤波延迟电路,一级滤波电路,二级滤波电路等组成,还设置有光束激发式逻辑放大电路和滤波放大电路,而在场效应管MOS的源极与电阻R3的电路上则串接有逻辑保护射极耦合式放大电路。本发明能够更好的对信号进行过滤与放大,大大提高了产品的适应能力与精准性,其整体结构简单,其制作和使用非常方便。同时,本发明完全采用逻辑电子元件来实现其逻辑控制功能,因此其能耗非常低,运算速度快。
搜索关键词: 基于 逻辑 保护 耦合 激发 逻辑电路 滤波 控制系统
【主权项】:
基于逻辑保护射极耦合激发式逻辑电路的滤波控制系统,主要由场效应管MOS,非门IC1,非门IC3,非门IC4,输入端与非门IC1的输出端相连接的非门IC2,与非门IC2的输出端相连接的滤波延迟电路,与非门IC1的输入端相连接的一级滤波电路,与非门IC3的输入端相连接二级滤波电路,与非门IC4的输出端相连接的异或门电路,一端与场效应管MOS的栅极相连接、另一端与非门IC1的输出端相连接的电阻R3,一端与场效应管MOS的栅极相连接、另一端与异或门电路相连接的电阻R5,正极与场效应管MOS的栅极相连接、其负极与非门IC3的输出端相连接的电容C3,以及一端与场效应管MOS的漏极相连接、另一端接地的电阻R9组成,其特征在于,在场效应管MOS的源极与滤波延迟电路之间串接有光束激发式逻辑放大电路,而在场效应管MOS的源极与电阻R3的电路上则串接有串联设置的滤波放大电路(10)和逻辑保护射极耦合式放大电路(20);该光束激发式逻辑放大电路主要由功率放大器P1,与非门IC6,与非门IC7,与非门IC8,负极与功率放大器P1的正极输入端相连接、正极经光二极管D5后接地的极性电容C6,一端与极性电容C6的正极相连接、另一端经二极管D6后接地的电阻R10,正极与电阻R10和二极管D6的连接点相连接、负极与场效应管MOS的源极相连接的极性电容C8,一端与与非门IC6的负极输入端相连接、另一端与功率放大器P1的正极输入端相连接的电阻R11,串接在功率放大器P1的负极输入端与输出端之间的电阻R12,一端与与非门IC6的输出端相连接、另一端与与非门IC8的负极输入端相连接的电阻R13,正极与与非门IC7的输出端相连接、负极与与非门IC8的负极输入端相连接的电容C7,以及一端与极性电容C8的正极相连接、另一端与与非门IC7的负极输入端相连接的电阻R14组成;所述与非门IC6的正极输入端与功率放大器P1的负极输入端相连接,其输出端与与非门IC7的正极输入端相连接,与非门IC8的正极输入端与功率放大器P1的输出端相连接;所述功率放大器P1的正极输入端则与滤波延迟电路相连接,与非门IC7的负极输入端还与非门IC4的输出端相连接;所述滤波放大电路(10)由三极管VT101,三极管VT102,三极管VT103,三极管VT104,三极管VT105,三极管VT106,三极管VT107,运算放大器P101,运算放大器P102,一端作为输入端、另一端与三极管VT107的基极相连接的电阻R101,与电阻R101并联的电容C101,一端与三极管VT107的基极相连接、另一端经电阻R105后与三极管VT107的发射极相连接的电阻R103,一端与三极管VT107的基极相连接、另一端经电阻R104后与三极管VT107的集电极相连接的电阻R102,正极与三极管VT107的发射极相连接、负极与电阻R103和电阻R105的连接点相连接的电容C104,串接在三极管VT101的基极与发射极之间的电阻R114,一端接地、另一端与三极管VT102的基极相连接的电阻R113,P极与三极管VT103的基极相连接、N极经电容C103后与三极管VT107的集电极相连接的二极管D101,P极经二极管D102后与二极管D101的N极相连接、N极与三极管VT106的基极相连接的二极管D103,串接在三极管VT106的基极与集电极之间的电阻R111,一端接地、另一端与三极管VT104的发射极相连接的电阻R112,负极接地、正极经电阻R106后与电容C104的正极相连接的电容C105,一端与电容C105的正极相连接、另一端与运算放大器P101的负输入端相连接的电阻R108,一端与电容C105的正极相连接、另一端与运算放大器P101的输出端相连接的电阻R107,串接在运算放大器P101的负输入端与输出端之间的电容C106,负极接地、正极与运算放大器P102的正输入端相连接的电容C108,负极经电阻R109后与运算放大器P101的输出端相连接、正极与运算放大器P102的负输入端相连接的电容C107,一端与电容C107的负极相连接、另一端与电容C108的正极相连接的电阻R110,以及负极与三极管VT107的基极相连接、正极经电阻R115后与三极管VT104的发射极相连接的电容C102组成;其中,电容C104的负极还同时与三极管VT106的集电极和三极管VT105的集电极相连接,三极管VT101的发射极、三极管VT103的集电极和三极管VT104的集电极均与电阻R102和电阻R104的连接点相连接,三极管VT101的基极与三极管VT102的发射极相连接,三极管VT101的集电极与三极管VT102的基极相连接,三极管VT102的集电极与三极管VT103的基极相连接,三极管VT103的发射极与三极管VT104的基极相连接,三极管VT104的发射极与三极管VT105的发射极相连接,三极管VT105的基极与三极管VT106的发射极相连接,运算放大器P101的正输入端接地,电容C107的正极还同时与运算放大器P102的输出端以及二极管D101的N极相连接,所述三极管VT104的发射极作为输出端且经电阻R3后与与非门IC1的输出端相连接;所述逻辑保护射极耦合式放大电路(20)主要由三极管Q1,三极管Q2,功率放大器P2,功率放大器P3,串接在功率放大器P2的负极输入端与输出端之间的电阻R16,串接在功率放大器P3的正极输入端与输出端之间的极性电容C11,串接在功率放大器P2的正极输入端与三极管Q1的集电极之间的电阻R15,串接在三极管Q1的集电极与三极管Q2的基极之间的电阻R17,与电阻R17相并联的电容C10,负极与功率放大器P2的正极输入端相连接、正极经电阻R18后与三极管Q1的发射极相连接的极性电容C9,串接在三极管Q2的基极与极性电容C9的正极之间的电阻R19,正极与三极管Q2的发射极相连接、负极顺次经稳压二极管D7和电阻R20后与功率放大器P2的输出端相连接的电容C12,P极与功率放大器P3的输出端相连接、N极经电阻R22和电阻R21后与稳压二极管D7与电阻R20的连接点相连接的二极管D8,以及P极与电容C12的负极相连接、N极与二极管D8与电阻R22的连接点相连接的稳压二极管D9组成;所述三极管Q1的基极与极性电容C9的正极相连接,其发射极与三极管Q2的发射极相连接,其集电极与功率放大器P2的负极输入端相连接;三极管Q2的集电极与功率放大器P3的负极输入端相连接,功率放大器P3的正极输入端与功率放大器P2的输出端相连接;所述极性电容C9的正极与场效应管MOS的栅极相连接,而电阻R22与电阻R21的连接点则与电阻R101的输入端相连接。
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