[发明专利]高电压阈值器件的传输门及其后续下拉电路结构有效
申请号: | 201510341803.8 | 申请日: | 2015-06-18 |
公开(公告)号: | CN106330172B | 公开(公告)日: | 2019-04-09 |
发明(设计)人: | 耿彦;陈捷;朱恺 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H03K19/0185 | 分类号: | H03K19/0185 |
代理公司: | 北京市磐华律师事务所 11336 | 代理人: | 董巍;高伟 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 本发明提供一种传输门及其下拉电路结构,包括并联在信号输入端和信号输出端之间的第一NMOS晶体管和PMOS晶体管,其中所述PMOS晶体管的衬底连接到电源电压且所述第一NMOS晶体管的衬底连接到地,所述第一NMOS晶体管连接到第一信号针,PMOS晶体管的栅极连接到第二信号针,其特征在于:第一NMOS晶体管为本征NMOS晶体管,且包括串联在信号输出端与地之间的栅极与漏极直连的第二NMOS晶体管以及第三NMOS晶体管,所述第三NMOS晶体管的栅极连接到第二信号针。本发明针对高电压阈值器件电路,能够使得具有本征NMOS晶体管的传输门电路即使在较低的电源电压下且输入信号为不满幅的情况下保持在上升沿和下降沿顺利导通,有效地发挥逻辑功能。并且,添加栅漏直连的NMOS晶体管的下拉电路能够在较大的电源电压范围内有效地减少漏电流。 | ||
搜索关键词: | 电压 阈值 器件 传输 及其 后续 下拉 电路 结构 | ||
【主权项】:
1.一种传输门及其下拉电路结构,包括并联在信号输入端和信号输出端之间的第一NMOS晶体管和PMOS晶体管,以及信号输出端与地之间的第二NMOS晶体管,其中所述PMOS晶体管的衬底连接到电源电压且所述第一NMOS晶体管的衬底连接到地,所述第一NMOS晶体管的漏极和PMOS晶体管的漏极与信号输入端相连,所述第一NMOS晶体管的源极、PMOS晶体管的源极和第二NMOS晶体管的漏极与信号输出端相连,所述第二NMOS晶体管的源极连接到地,所述第一NMOS晶体管的栅极连接到第一信号针,所述PMOS晶体管和第二NMOS晶体管的栅极连接到第二信号针,所述第二信号针与第一信号针的逻辑电平高低相反,其特征在于:所述第一NMOS晶体管为本征NMOS晶体管。
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