[发明专利]一种用于调整时钟频率和相位的方法在审
| 申请号： | 201510390536.3 | 申请日： | 2015-06-30 |
| 公开（公告）号： | CN105007075A | 公开（公告）日： | 2015-10-28 |
| 发明（设计）人： | 方学南 | 申请（专利权）人： | 深圳市芯海科技有限公司 |
| 主分类号： | H03L7/081 | 分类号： | H03L7/081;H03K3/64;H03K4/06;G01R31/28 |
| 代理公司： | 深圳市凯达知识产权事务所 44256 | 代理人： | 刘大弯 |
| 地址： | 518067 广东省深圳市南山*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种用于调整时钟频率和相位的方法，该方法包括：上位机上根据需要编辑FPGA输出的波形、频率和相位命令集，然后通过串口把相关操作指令传送给FPGA处理器；FPGA处理器接收上位机响应后，对命令进行解析；等待待测试芯片的应答；接收应答信号后，把相应信号告诉FPGA处理器，进行测试。本发明与常规方法相比，要达到同等ESD水平，所需要的NMOS和PMOS面积大为减小。这样通过ESD保护器件与驱动管复用，减小电路面积。本发明在芯片测试的时候，能够根据需要对时钟频率和相位进行调整，以能够快速、准确地进行芯片测试，仅仅通过控制流程实现，能够进行自动化测试，可以大大降低芯片测试成本，而且测试设备占用空间小。 | ||
| 搜索关键词： | 一种 用于 调整 时钟 频率 相位 方法 | ||
【主权项】：
一种用于调整时钟频率和相位的方法，其特征在于该方法包括如下步骤：101、上位机上根据需要编辑FPGA输出的波形、频率和相位命令集，然后通过串口把相关操作指令传送给FPGA处理器；102、FPGA处理器接收上位机响应后，对命令进行解析；等待待测试芯片的应答；103、接收应答信号后，把相应信号告诉FPGA处理器，对相应数据进行解析发送给上位机，上位机对检测到的信号和设定值进行对比分析，检测时钟频率是否到达设定值；104、时钟频率到达设定值，则进行测试。
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