[发明专利]基于FPGA的正交调制电路的EVM的调试方法有效
申请号: | 201510403010.4 | 申请日: | 2015-07-10 |
公开(公告)号: | CN104977889B | 公开(公告)日: | 2017-09-12 |
发明(设计)人: | 刘畅;戴荣;阴陶;林峰 | 申请(专利权)人: | 成都傅立叶电子科技有限公司 |
主分类号: | G05B19/042 | 分类号: | G05B19/042 |
代理公司: | 成都行之专利代理事务所(普通合伙)51220 | 代理人: | 李朝虎 |
地址: | 610000 四川省成都*** | 国省代码: | 四川;51 |
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摘要: | 本发明公开了一种基于FPGA的正交调制电路及调试其EVM的方法,基于FPGA的正交调制电路,包括以下部件FPGA、与FPGA连接的DA、与DA连接的电容电阻网络;与电容电阻网络连接的正交调制器;FPGA采用分时复用的方式将I相位数据和Q相位数据送入DA;DA将I相位数据和Q相位数据转换为模拟的I路基带信号和模拟的Q路基带信号,最后通过I通道将I路基带信号送入电容电阻网络,通过Q通道将Q路基带信号送入电容电阻网络;电容电阻网络将I路基带信号和Q路基带信号进行直流偏置和滤波处理;正交调制器对电容电阻网络输出的I路基带信号和Q路基带信号进行正交调制,最后形成RF信号输出。 | ||
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【主权项】:
基于FPGA的正交调制电路的EVM的调试方法,其特征在于:基于FPGA的正交调制电路,包括以下部件:输出数字基带信号的FPGA;通过数据总线与FPGA连接的DA;通过I通道和Q通道与DA连接的电容电阻网络;与电容电阻网络连接的正交调制器;FPGA采用分时复用的方式将数字基带信号的I相位数据和Q相位数据送入DA;DA通过数据总线接收I相位数据和Q相位数据,并且,DA将I相位数据和Q相位数据转换为模拟的I路基带信号和模拟的Q路基带信号,最后通过I通道将I路基带信号送入电容电阻网络,通过Q通道将Q路基带信号送入电容电阻网络;电容电阻网络将I路基带信号和Q路基带信号进行直流偏置和滤波处理;正交调制器对电容电阻网络输出的I路基带信号和Q路基带信号进行正交调制,最后形成RF信号输出;调试方法包括以下步骤:步骤A、设置初始值:由FPGA根据DA的编码类型选择I相位数据和Q相位数据的初始值,如果DA是偏移码编码,则初始值的MSB位填1,其它位填0,如果DA是二进制补码编码,则初始值的全部位填0;步骤B、选定I相位数据的基准零值:通过FPGA逐渐增大I相位数据的值,观察RF信号中心频率的功率是否随I相位数据值的增加而渐渐向底噪降低,如果向底噪降低,则继续增大I相位数据的值,直至RF信号中心频率的功率停止降低开始增加,此时将I相位数据的值改为功率停止降低前的值,将其作为I相位数据的基准零值;如果逐渐增大I相位数据的值,RF信号中心频率的功率没有随I相位数据值的增加而渐渐向底噪降低,此时应逐渐减小I相位数据的值,中心频率的功率会渐渐降低,直至RF信号中心频率的功率停止降低开始增加,此时将I相位数据的值改为功率停止降低前的值,将其作为I相位数据的基准零值;步骤C、选定Q相位数据的基准零值:通过FPGA逐渐增大Q相位数据的值,观察RF信号中心频率的功率是否随Q相位数据值的增加而渐渐向底噪降低,如果向底噪降低,则继续增大Q相位数据的值,直至RF信号中心频率的功率停止降低开始增加,此时将Q相位数据的值改为功率停止降低前的值,将其作为Q相位数据的基准零值;如果逐渐增大Q相位数据的值,RF信号中心频率的功率没有随Q相位数据值的增加而渐渐向底噪降低,此时应逐渐减小Q相位数据的值,中心频率的功率会渐渐降低,直至RF信号中心频率的功率停止降低开始增加,此时将Q相位数据的值改为功率停止降低前的值,将其作为Q相位数据的基准零值;步骤D、计算差值:获得I相位数据的基准零值和Q相位数据的基准零值后,I相位数据的基准零值大于初始值,则用I相位数据的基准零值减去初始值后获得差值,在FPGA里编写调制应用程序时I相位数据加上该差值,若I相位数据的基准零值小于初始值,则用初始值减去I相位数据的基准零值后获得差值,在FPGA里编写调制应用程序时I相位数据减去该差值,同样,Q相位数据的基准零值大于初始值时,则用Q相位数据的基准零值减去初始值后获得差值,在FPGA里编写调制应用程序时Q相位数据加上该差值,若Q相位数据的基准零值小于初始值,则用初始值减去Q相位数据的基准零值后获得差值,在FPGA里编写调制应用程序时Q相位数据减去该差值。
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