[发明专利]一种船用雷达控制系统有效
申请号: | 201510464004.X | 申请日: | 2015-07-31 |
公开(公告)号: | CN105182843B | 公开(公告)日: | 2017-08-29 |
发明(设计)人: | 陈波;全成;段衍东;李道涵;龚时鹏 | 申请(专利权)人: | 宁波成电泰克电子信息技术发展有限公司 |
主分类号: | G05B19/042 | 分类号: | G05B19/042 |
代理公司: | 宁波奥圣专利代理事务所(普通合伙)33226 | 代理人: | 方小惠 |
地址: | 315040 浙江省宁*** | 国省代码: | 浙江;33 |
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摘要: | 本发明公开了一种船用雷达控制系统,包括电源、交互控制电路、信号处理电路、伺服驱动电路和收发控制电路,电源、交互控制电路、信号处理电路、伺服驱动电路和收发控制电路均为采用数字器件设计的电路,电源分别与交互控制电路、信号处理电路、伺服驱动电路和收发控制电路连接,交互控制电路分别与信号处理电路和伺服驱动电路连接,信号处理电路分别与伺服驱动电路和收发控制电路连接,交互控制电路用于接入外部主机和外部SD卡,伺服驱动电路用于连接外部电机和外部光电码盘,收发控制电路用于连接外部发射机和外部接收机;优点是体积较小,功耗较低,便携性优,性能好和可维护性优。 | ||
搜索关键词: | 一种 雷达 控制系统 | ||
【主权项】:
一种船用雷达控制系统,其特征在于包括电源、交互控制电路、信号处理电路、伺服驱动电路和收发控制电路;所述的电源、所述的交互控制电路、所述的信号处理电路、所述的伺服驱动电路和所述的收发控制电路均为采用数字器件设计的电路;所述的电源分别与所述的交互控制电路、所述的信号处理电路、所述的伺服驱动电路和所述的收发控制电路连接,所述的交互控制电路分别与所述的信号处理电路和所述的伺服驱动电路连接,所述的信号处理电路分别与所述的伺服驱动电路和所述的收发控制电路连接,所述的交互控制电路用于接入外部主机和外部SD卡,所述的伺服驱动电路用于连接外部电机和外部光电码盘,所述的收发控制电路用于连接外部发射机和外部接收机;所述的交互控制电路包括ARM模块和网卡模块;所述的ARM模块包括型号为S3C2416的ARM芯片及外围电路,所述的网卡模块包括型号为DM9000的网卡芯片及其外围电路;所述的ARM芯片具有SD接口、系统总线接口和两个RS232接口,两个RS232接口分别为第一RS232接口和第二RS232接口,所述的ARM芯片的第一RS232接口用于与外部主机连接,所述的ARM芯片的第二RS232接口和所述的伺服驱动电路连接,所述的ARM芯片的SD接口用于与外部SD卡连接,所述的ARM芯片的系统总线接口与所述的信号处理电路连接,所述的ARM芯片与所述的网卡芯片连接,所述的网卡芯片用于接入外部主机;所述的信号处理电路包括FPGA模块、SRAM模块和NAND FLASH模块;所述的FPGA模块分别与所述的SRAM模块和所述的NAND FLASH模块连接;所述的FPGA模块包括型号为XC6SLX150‑2FG484C的FPGA芯片及其外围电路;所述的FPGA模块的第2脚,第3脚,第4脚,第5脚,第6脚,第7脚,第8脚,第9脚,第10脚,第11脚,第12脚,第13脚,第14脚,第15脚,第16脚,第17脚,第18脚,第19脚,第20脚,第21脚,第22脚,第23脚,第24脚和第27脚构成系统总线接口与ARM芯片连接,所述的FPGA芯片的第2脚与所述的ARM芯片的第31脚连接,所述的FPGA芯片的第3脚与所述的ARM芯片的第30脚连接,所述的FPGA芯片的第4脚与所述的ARM芯片的第47脚连接,所述的FPGA芯片的第5脚与所述的ARM芯片的第36脚连接,所述的FPGA芯片的第6脚与所述的ARM芯片的第34脚连接,所述的FPGA芯片的第7脚与所述的ARM芯片的第35脚连接,所述的FPGA芯片的第8脚与所述的ARM芯片的第33脚连接,所述的FPGA芯片的第9脚与所述的ARM芯片的第29脚连接,所述的FPGA芯片的第10脚与所述的ARM芯片的第28脚连接,所述的FPGA芯片的第11脚与所述的ARM芯片的第27脚连接,所述的FPGA芯片的第12脚与所述的ARM芯片的第26脚连接,所述的FPGA芯片的第13脚与所述的ARM芯片的第25脚连接,所述的FPGA芯片的第14脚与所述的ARM芯片的第24脚连接,所述的FPGA芯片的第15脚与所述的ARM芯片的第23脚连接,所述的FPGA芯片的第16脚与所述的ARM芯片的第22脚连接,所述的FPGA芯片的第17脚与所述的ARM芯片的第21脚连接,所述的FPGA芯片的第18脚与所述的ARM芯片的第20脚连接,所述的FPGA芯片的第19脚与所述的ARM芯片的第19脚连接,所述的FPGA芯片的第20脚与所述的ARM芯片的第18脚连接,所述的FPGA芯片的第21脚与所述的ARM芯片的第17脚连接,所述的FPGA芯片的第22脚与所述的ARM芯片的第16脚连接,所述的FPGA芯片的第23脚与所述的ARM芯片的第15脚连接,所述的FPGA芯片的第24脚与所述的ARM芯片的第14脚连接,所述的FPGA芯片的第27脚与所述的ARM芯片的第3脚连接,所述的FPGA芯片的第37脚、第38脚、第39脚和第40脚构成SPI接口,所述的FPGA芯片的SPI接口与所述的收发控制电路连接,所述的FPGA芯片的第25脚与所述的伺服驱动电路连接。
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