[发明专利]处理序列输入/输出串流的方法及装置有效

专利信息
申请号: 201510486112.7 申请日: 2015-08-10
公开(公告)号: CN105373341B 公开(公告)日: 2019-10-18
发明(设计)人: 查柯利·大卫·卓特;麦克·大卫·巴瑞尔 申请(专利权)人: 达西系统股份有限公司
主分类号: G06F3/06 分类号: G06F3/06
代理公司: 上海专利商标事务所有限公司 31100 代理人: 何焜
地址: 美国科罗拉多州*** 国省代码: 美国;US
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摘要: 发明提供一种可以有效地处理序列的输入/输出请求并行串流的方法。当接收到输入/输出串流时,则确认输入/输出请求是否对应于有效串流。如果输入/输出请求对应于有效串流,则针对与有效串流对应的有效表的目前的有效表入口进行更新。如果输入/输出请求没有对应于有效串流,则将非有效表的非有效表入口转变为新的有效表入口。非有效表存储有可利用但未经配置的资源,而有效表存储有经过配置的资源。有效表头端对应于最近最常使用的有效表入口,而有效表尾端对应于最近最少使用的有效表入口。
搜索关键词: 处理 序列 输入 输出 串流 方法 装置
【主权项】:
1.一种有效处理存储控制器之序列输入/输出请求的多个并行串流的方法,以便反应存储控制器接收到来自于主机电脑的主机输入/输出请求的情形,该方法包括:通过该存储控制器,判断该主机输入/输出请求是否对应于一有效串流;如果该主机输入/输出请求对应于该有效串流时,接着通过该存储控制器对于一有效表中的目前的有效表入口进行更新,其中该有效表对应于一有效串流;如果该主机输入/输出请求没有对应于该有效串流,接着:通过该存储控制器,将一非有效表中的一非有效表入口转变为该有效表中的一个新的有效表入口;以及通过该存储控制器,配置该新的有效表入口,其中该非有效表存储有可用但未配置的数个存储控制器记忆体资源,其中,该有效表存储有已配置的存储控制器记忆体资源,该有效表包含有一有效表头端以及一相对的有效表尾端,该有效表头端对应于一个最近最常使用的有效表入口,而该有效表尾端对应于一个最近最少使用的有效表入口。
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