[发明专利]数据写系统和用于核心处理器的数据写方法有效
申请号: | 201510751093.6 | 申请日: | 2015-11-06 |
公开(公告)号: | CN105760317B | 公开(公告)日: | 2018-10-16 |
发明(设计)人: | 乔梦麟 | 申请(专利权)人: | 联发科技股份有限公司 |
主分类号: | G06F13/16 | 分类号: | G06F13/16 |
代理公司: | 北京市万慧达律师事务所 11111 | 代理人: | 白华胜;王蕊 |
地址: | 中国台湾新竹科*** | 国省代码: | 中国台湾;71 |
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摘要: | 本发明实施例公开了数据写系统和数据写方法。其中系统包括:处理单元、存储设备、动态随机存取存储器DRAM和总线仲裁器,所述DRAM包括:用户缓冲器;缓冲器高速缓存器;以及直接存储器访问缓冲器;其中,所述处理单元用于执行多个写事件以通过第一写路径将所述数据的一部分从所述DRAM的所述用户缓冲器移至所述存储设备,以及通过第二写路径将所述数据的剩余部分从所述DRAM的所述用户缓冲器移至所述存储设备;其中,所述第一写路径经过所述DRAM的所述缓冲器高速缓存器,所述第二写路径不经过所述DRAM的所述缓冲器高速缓存器。实施本发明实施例减少了功率消耗并降低了对所述DRAM的访问次数。 | ||
搜索关键词: | 数据 系统 用于 核心 处理器 方法 | ||
【主权项】:
1.一种数据写系统,包括:处理单元、存储设备、动态随机存取存储器和总线仲裁器,其中,所述动态随机存取存储器包括:用户缓冲器,用于存储需写入所述存储设备的数据;缓冲器高速缓存器;以及直接存储器存取缓冲器;其中,所述总线仲裁器耦接于所述处理单元、所述动态随机存取存储器以及所述存储设备之间;其中,所述处理单元用于执行多个写事件以通过第一写路径将所述数据的一部分从所述动态随机存取存储器的所述用户缓冲器移至所述存储设备,以及通过第二写路径将所述数据的剩余部分从所述动态随机存取存储器的所述用户缓冲器移至所述存储设备;其中,所述第一写路径经过所述动态随机存取存储器的所述缓冲器高速缓存器,所述第二写路径不经过所述动态随机存取存储器的所述缓冲器高速缓存器。
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