[实用新型]一种用于星载环境下的队列缓存器有效
申请号: | 201520324680.2 | 申请日: | 2015-05-19 |
公开(公告)号: | CN204719742U | 公开(公告)日: | 2015-10-21 |
发明(设计)人: | 杨磊;惠腾飞;龚险峰;马婷;王诗力 | 申请(专利权)人: | 西安空间无线电技术研究所 |
主分类号: | G06F12/08 | 分类号: | G06F12/08 |
代理公司: | 中国航天科技专利中心 11009 | 代理人: | 安丽 |
地址: | 710100 陕*** | 国省代码: | 陕西;61 |
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摘要: | 本实用新型一种用于星载环境下的队列缓存器包括队列信息RAM、逻辑地址RAM、CRC生成器、CRC校验器、RAM地址控制器、SDRAM地址映射电路、SDRAM控制器、SDRAM存储芯片、SDRAM数据缓存器、接收数据缓存器、发送数据缓存器。本实用新型可以实现对指针寄存器在空间单粒子干扰下发生错误的防护以及对发生错误的识别和更正,同时本实用新型实现了缓存队列管理的低资源高可靠性要求,既可用于星载处理器中,也可以用于高可靠性的地面设备中。 | ||
搜索关键词: | 一种 用于 环境 队列 缓存 | ||
【主权项】:
一种用于星载环境下的队列缓存器,其特征在于包括:队列信息RAM、逻辑地址RAM、CRC生成器、CRC校验器、RAM地址控制器、SDRAM地址映射电路、SDRAM控制器、SDRAM存储芯片、SDRAM数据缓存器、接收数据缓存器、发送数据缓存器;队列信息RAM的第一输入端连接RAM地址控制器的第一输出端,队列信息RAM的第二输入端连接CRC生成器的第一输出端;队列信息RAM的输出端连接CRC校验器的第一输入端;逻辑地址RAM的第一输入端连接RAM地址控制器的第二输出端,逻辑地址RAM的第二输入端连接CRC生成器的第二输出端;逻辑地址RAM输出端连接CRC校验器的第二输入端;CRC校验器的输出端,连接RAM地址控制器的第一输入端;CRC生成器的输入端,连接RAM地址控制器的第三输出端;RAM地址控制器的第四输出端,连接SDRAM地址映射电路的输入端;SDRAM地址映射电路的输出端,连接SDRAM控制器的第一输入端;SDRAM控制器,与SDRAM数据缓存器交互连接;SDRAM控制器,与SDRAM存储芯片交互连接;SDRAM数据缓存器,与数据总线交互连接;接收数据缓存器的输入端连接分组输入的外接数据,输出端连接数据总线;发送数据缓存器的输入端连接数据总线,输出端连接外部。
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