[实用新型]一种60秒定时器电路有效

专利信息
申请号: 201520517367.0 申请日: 2015-07-17
公开(公告)号: CN204794939U 公开(公告)日: 2015-11-18
发明(设计)人: 闵建亮 申请(专利权)人: 江西科技学院
主分类号: H03K17/28 分类号: H03K17/28
代理公司: 暂无信息 代理人: 暂无信息
地址: 330098 江*** 国省代码: 江西;36
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摘要: 实用新型公开了一种60秒定时器电路,其目的在于提供一种操作方便、计时准确的定时器电路,整个电路由三个部分组成,分别是计数器部分,译码器部分和数码管显示部分,所述计数器部分主要用于设置初始时间和进行减法计算,所述译码器部分负责将二进制数字信号转化为十进制数字,驱动数码管显示数字,所述数码管显示部分用于显示数字,可以显示每来一次脉冲的数值。
搜索关键词: 一种 60 定时器 电路
【主权项】:
一种60秒定时器电路,其特征在于:所述电路包括计数器部分,译码器部分和数码管显示部分,所述计数器部分包括个位的十进制可逆计数器芯片CC74HC192和十进制可逆计数器芯片CC74HC192;所述译码器部分包括译码器CC4511和译码器CC4511;所述数码管显示部分包括数码管和数码管;所述计数器部分主要用于设置初始时间和进行减法计算,所述译码器部分负责将二进制数字信号转化为十进制数字,驱动数码管显示数字,所述数码管显示部分用于显示数字,可以显示每来一次脉冲的数值;其电路连接为:所述十进制可逆计数器芯片CC74HC192为个位,其清零位CR端、数据输入信号D3~D0接零地GND1,加计数时钟输入端CPU接+5V的高电平,减计数时钟输入端CPD接秒脉冲CP,所述十进制可逆计数器芯片CC74HC192的输出端Q3~Q0接所述译码器CC4511的输入端,进位标志CO悬空,借位标志BO接到十进制可逆计数器芯片CC74HC192的减计数时钟输入端CPD,所述十进制可逆计数器芯片CC74HC192为十位,其清零端CR、D3和D0接地GND2,D2和D1接+5V的电源,十进制可逆计数器芯片CC74HC192的加计数时钟输入端CPU接+5V的高电平,减计数时钟输入端CPD接所述十进制可逆计数器芯片CC74HC192的借位输出端BO,所述十进制可逆计数器芯片CC74HC192的进位标志CO悬空,借位标志BO悬空,其输出信号Q3~Q0接所述译码器CC4511的输入端;所述十进制可逆计数器芯片CC74HC192和所述十进制可逆计数器芯片CC74HC192的置数端LD与3k的电阻连在一起,电阻的另一端接+5V的电源,3k的电阻同时连接开关S,开关S有两端,一端为开始端,一端为置数端;所述译码器CC4511和所述译码器CC4511是用来驱动对应的数码管显示数据的;所述译码器CC4511和所述译码器CC4511的输入端A3~A0分别接所述十进制可逆计数器芯片CC74HC192和所述十进制可逆计数器芯片CC74HC192的输出端Q3~Q0,锁定端LE接低电平,消隐输入端BI和测试输入端LT都接+5V的电源,所述译码器CC4511和所述译码器CC4511的输出端Ya~Yg端分别通过电阻R连接至所述数码管和所述数码管的a~g端。
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