[实用新型]一种电子式互感器合并单元的时间同步装置有效
| 申请号： | 201520926054.0 | 申请日： | 2015-11-19 |
| 公开（公告）号： | CN205263514U | 公开（公告）日： | 2016-05-25 |
| 发明（设计）人： | 田晓霄;李水清;方临川;李晓丹 | 申请（专利权）人： | 正泰电气股份有限公司 |
| 主分类号： | G04G7/00 | 分类号： | G04G7/00 |
| 代理公司： | 上海申汇专利代理有限公司 31001 | 代理人： | 翁若莹 |
| 地址： | 201614 *** | 国省代码： | 上海;31 |
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| 摘要： | 本实用新型提供了一种电子式互感器合并单元的时间同步装置，其特征在于，包括CPU、以太网收发器(PHY)和现场可编程门阵列(FPGA)芯片，所述的CPU包含以太网MAC控制器模块和PTP协议模块，所述的以太网收发器(PHY)连接CPU的以太网MAC控制器模块，所述现场可编程门阵列(FPGA)芯片通过CPU总线与CPU连接。本实用新型采用FPGA和MPC8313(E)双处理器为核心的硬件系统，利用FPGA来完成对多路电子式互感器的数据采集和传输。MPC8313则作为主CPU，不仅完成了对采集数据的复杂处理，而且实现了PTP协议，使得时间同步精度达到亚微秒级。 | ||
| 搜索关键词： | 一种 电子 互感器 合并 单元 时间 同步 装置 | ||
【主权项】：
一种电子式互感器合并单元的时间同步装置，其特征在于，包括CPU、以太网收发器和现场可编程门阵列芯片，所述的CPU包含以太网MAC控制器模块和PTP协议模块，所述的以太网收发器连接CPU的以太网MAC控制器模块，所述现场可编程门阵列芯片通过CPU总线与CPU连接。
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