[实用新型]一种数据处理器有效

专利信息
申请号: 201521055304.4 申请日: 2015-12-18
公开(公告)号: CN205430271U 公开(公告)日: 2016-08-03
发明(设计)人: 王玮;徐洪洲;刘秀芳 申请(专利权)人: 王玮;徐洪洲;刘秀芳
主分类号: H04L12/02 分类号: H04L12/02;H04L29/06
代理公司: 暂无信息 代理人: 暂无信息
地址: 116000 辽宁省大连*** 国省代码: 辽宁;21
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摘要: 一种数据处理器,包括CPU处理单元、进程调度芯片、预处理单元和接口单元,所述CPU处理单元包括多个嵌入设置的CPU,预处理单元设置有多个FPGA,接口单元包括SMT-1接口、RJ-45接口、SC光纤接口和FDDI接口,各个嵌入设置的CPU通过电路与进程调度芯片后端连接,所述FPGA包括区分电路、逻辑处理模块、外部协议处理器和汇总电路,逻辑处理模块和外部协议处理器的前端均与区分电路后端连接,逻辑处理模块和外部协议处理器的后端均与汇总电路前端连接,各个接口后端与对应的区分电路前端连接,各个汇总电路与进程调度芯片前端对应位置连接,本实用新型结构简单,设备体积小,灵活性强,解决了FPGA处理业务数据的瓶颈问题,能够实现高效的数据处理能力。
搜索关键词: 一种 数据 处理器
【主权项】:
一种数据处理器,包括CPU处理单元、进程调度芯片、预处理单元和接口单元,其特征在于,所述CPU处理单元包括多个嵌入设置的CPU,预处理单元设置有多个FPGA,接口单元包括SMT‑1接口、RJ‑45接口、SC光纤接口和FDDI接口,各个嵌入设置的CPU通过电路与进程调度芯片后端连接,所述FPGA包括区分电路、逻辑处理模块、外部协议处理器和汇总电路,逻辑处理模块和外部协议处理器的前端均与区分电路后端连接,逻辑处理模块和外部协议处理器的后端均与汇总电路前端连接,各个接口后端与对应的区分电路前端连接,各个汇总电路与进程调度芯片前端对应位置连接。
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