[发明专利]用于使得处理器能够生成流水线控制信号的方法和装置有效
| 申请号： | 201580012420.4 | 申请日： | 2015-02-02 |
| 公开（公告）号： | CN106465404B | 公开（公告）日： | 2019-11-26 |
| 发明（设计）人： | C·J·格罗斯尼尔;G·J·纳赛尔;M·森迪尔威兰;V·卡拉什尼科夫;A·J·霍安;P·达西;S·D·兰库;王生洪 | 申请（专利权）人： | 优创半导体科技有限公司 |
| 主分类号： | H04W72/12 | 分类号： | H04W72/12 |
| 代理公司： | 11038 中国国际贸易促进委员会专利商标事务所 | 代理人： | 李颖<国际申请>=PCT/US2015/ |
| 地址： | 美国*** | 国省代码： | 美国;US |
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| 摘要： | 计算机处理器的链接位解码器接收指令流。链接位解码器从指令流选择一组指令。链接位解码器从指令流的每个指令提取指定位以产生链接位序列。链接位解码器对链接位序列进行解码。链接位解码器基于解码后的链接位序列来识别选中的一组指令之中的零或更多指令流依赖关系。链接位解码器基于指令的组序列之中的识别出的零或更多指令流依赖关系来输出控制信号以使处理器的一个或多个流水线级执行选中的一组指令。 | ||
| 搜索关键词： | 用于 使得 处理器 能够 生成 流水线 控制 信号 方法 装置 | ||
【主权项】：
1.一种方法，包括：/n通过处理器从指令流选择一组指令；/n通过所述处理器从所述一组指令中的每个指令提取相应的指定位；/n通过所述处理器对所提取的指定位进行编码以形成链接位序列，其中所述链接位序列要对用于所述一组指令的多个执行模式进行编码，并且其中所述链接位序列包括对应于组内并行执行模式的第一位和对应于组间并行执行模式的第二位；/n通过所述处理器对所述链接位序列进行解码以确定所述多个执行模式中的第一执行模式；/n通过所述处理器基于所述第一执行模式来识别选中的一组指令之中的零或更多指令流依赖关系；以及/n通过所述处理器基于选中的一组指令之中的识别出的零或更多指令流依赖关系来输出控制信号以使所述处理器的一个或多个流水线级执行选中的一组指令。/n
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