[发明专利]用于管理具有三模冗余的电路的操作的方法及相关装置有效
| 申请号： | 201580034800.8 | 申请日： | 2015-06-26 |
| 公开（公告）号： | CN106662614B | 公开（公告）日： | 2020-01-07 |
| 发明（设计）人： | J-M·达维奥;S·克勒克;P·罗彻 | 申请（专利权）人： | 意法半导体(克洛尔2)公司 |
| 主分类号： | G01R31/3177 | 分类号： | G01R31/3177 |
| 代理公司： | 11256 北京市金杜律师事务所 | 代理人： | 王茂华;吕世磊 |
| 地址： | 法国*** | 国省代码： | 法国;FR |
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| 摘要： | 管理逻辑部件(2)的操作的方法，该逻辑部件(2)包括多数表决电路(3)和至少等于三个的奇数个触发器(4至6)，该方法包括：a)在部件的正常操作模式之后，将部件(2)置于测试模式，在测试模式中：逻辑部件(2)的触发器(4)被置于测试模式，测试信号(TI)被注入到被测试的触发器(4)的测试输入(ti)，其它触发器(5和6)的逻辑状态被冻结，以及测试输出信号(TQ)被分析，以及然后，b)在测试结束时，将部件(2)新置于正常操作模式，多数表决电路(3)自动恢复在启动测试之前存在的部件(2)的输出信号(Q)的值。 | ||
| 搜索关键词： | 用于 管理 具有 冗余 电路 操作 方法 相关 装置 | ||
【主权项】：
1.一种用于管理逻辑部件(2)的操作的方法，所述逻辑部件(2)包括多数表决电路(3)和等于至少三个的奇数个触发器(4至6)，每个触发器(4至6)具有数据输入(d)、测试输入(ti)、测试输出(tq)和连接到所述多数表决电路(3)的输入的数据输出(q)，所述方法包括将所述逻辑部件(2)置于正常操作模式，在所述正常操作模式中相同的输入信号(D)被递送到每个数据输入(d)，并且所述多数表决电路(3)递送输出信号(M)，其特征在于，所述方法包括：/na)在正常操作模式之后，将所述部件置于测试模式，在所述测试模式中：/n所述逻辑部件(2)的所述奇数个触发器(4至6)中的一个触发器(4)被置于测试模式，/n测试信号(TI)被注入到被测试的触发器(4)的测试输入(ti)中，/n其它触发器(5和6)的逻辑状态被冻结，以及/n由所述被测试的触发器(4)的测试输出(tq)递送的测试输出信号(TQ)被分析，然后，/nb)在所述测试阶段结束时，将所述逻辑部件(2)返回到正常操作模式，所述多数表决电路(3)自动恢复在启动所述测试模式之前存在的在所述逻辑部件(2)的数据输出(q)上的测试输出信号(TQ)的值。/n
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