[发明专利]用于锁相环的快速频率扼制和重新锁定技术在审

专利信息
申请号: 201580045062.7 申请日: 2015-07-28
公开(公告)号: CN106575966A 公开(公告)日: 2017-04-19
发明(设计)人: I·A·高尔顿;M·佩德拉利-诺伊 申请(专利权)人: 高通股份有限公司
主分类号: H03L7/14 分类号: H03L7/14;H03L7/093;H03L7/099
代理公司: 北京市金杜律师事务所11256 代理人: 王茂华,张宁
地址: 美国加利*** 国省代码: 暂无信息
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摘要: 本公开的某些方面支持一种用于在锁相环(PLL)装置中快速频率扼制和重新锁定的方法和设备。本公开的方面展示了一种用于操作在用于产生周期性信号的PLL装置的开环控制(OLC)模式中的方法和设备。在OLC模式期间,可以禁用与PLL装置的数字受控振荡器(DCO)接口的电路的钟控。可以通过输入至DCO中的数字控制字直接地控制由DCO所产生周期性信号相关联的PLL输出频率。
搜索关键词: 用于 锁相环 快速 频率 扼制 重新 锁定 技术
【主权项】:
一种用于操作用于产生周期性信号的锁相环(PLL)装置的方法,包括:在所述PLL装置的第一操作模式中,将与所述周期性信号相关联的PLL输出频率锁定至目标值;将所述PLL装置的操作从所述第一操作模式切换至第二操作模式,从而保持所述PLL装置的在所述第一操作模式中的状态;在所述第二操作模式期间,禁用与所述PLL装置的数字受控振荡器(DCO)对接的电路装置的操作;在所述第二操作模式期间,通过输入至所述DCO中的数字控制字而直接控制与由DCO产生的所述周期性信号相关联的所述PLL输出频率;以及将所述PLL装置的操作从所述第二操作模式切换回至所述第一操作模式,其中恢复所述PLL装置的被保持的状态并且将所述PLL输出频率锁定至所述目标值。
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