[发明专利]编码装置、解码装置和发送装置有效
| 申请号： | 201580082885.7 | 申请日： | 2015-09-07 |
| 公开（公告）号： | CN108028668B | 公开（公告）日： | 2019-03-19 |
| 发明（设计）人： | 宫田好邦;杉原坚也;吉田英夫 | 申请（专利权）人： | 三菱电机株式会社 |
| 主分类号： | H03M13/27 | 分类号： | H03M13/27 |
| 代理公司： | 北京三友知识产权代理有限公司 11127 | 代理人： | 邓毅;马建军 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 纠错编码器(10)具有交织电路(31)、编码运算电路(321、322)和解交织电路(33)。交织电路(31)在标准速模式时，根据在1个系统的传输帧中以C列间隔排列的多列比特生成1个系统的编码前比特序列(IL1)，在2倍速模式时，根据在2个系统中的各系统的传输帧中以C/2列间隔排列的多列比特生成编码前比特序列(IL1、IL2)。编码运算电路(321、322)对1个系统的编码前比特序列(IL1)或2个系统的编码前比特序列(IL1、IL2)实施纠错编码。 | ||
| 搜索关键词： | 编码 装置 解码 发送 | ||
【主权项】：
1.一种编码装置，其以标准速模式和K倍速模式中的任意一方进行动作，对分别具有行方向和列方向的比特排列格式的多个传输帧实施纠错编码，其特征在于，所述编码装置具有：交织电路，其在所述标准速模式时在1个系统中输入所述多个传输帧时，执行重新排列所述1个系统的传输帧的比特序列顺序的第1交织处理，输出1个系统的编码前比特序列，在所述K倍速模式时将所述多个传输帧分成K个系统的传输帧进行输入时，执行重新排列所述K个系统的传输帧的比特序列顺序的第2交织处理，并列输出K个系统的编码前比特序列；编码运算电路组，其对所述1个系统的编码前比特序列和所述K个系统的编码前比特序列中的任意一方进行纠错编码；以及解交织电路，其对所述编码运算电路组的输出序列进行解交织处理，所述交织电路在所述标准速模式时，根据在所述1个系统的传输帧中以C列间隔排列的多列比特生成该1个系统的编码前比特序列，在所述K倍速模式时，根据在所述K个系统的传输帧的各系统的传输帧中以C/K列间隔排列的多列比特生成该各系统的编码前比特序列，其中，K为2以上的整数，C为K的倍数。
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