[发明专利]一种具有高稳定度的超低功耗时钟电路有效

专利信息
申请号: 201610045325.0 申请日: 2016-01-22
公开(公告)号: CN105515550B 公开(公告)日: 2017-12-29
发明(设计)人: 易俊;柯庆福 申请(专利权)人: 英麦科(厦门)微电子科技有限公司
主分类号: H03K3/011 分类号: H03K3/011;H03K3/012;H03K3/02
代理公司: 厦门市精诚新创知识产权代理有限公司35218 代理人: 何家富
地址: 361000 福建省*** 国省代码: 福建;35
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摘要: 发明公开了一种具有高稳定度的超低功耗时钟电路,包括时钟振荡电路和供电电路,所述供电电路为时钟振荡电路供电,所述供电电路包括N型第一晶体管和第二晶体管、P型第三晶体管和第一电容,所述N型第一晶体管和P型第三晶体管串联后接在电源V_DD与地之间,所述N型第一晶体管的偏置电压加载端接时钟振荡电路的电源输入端,所述P型第三晶体管的偏置电压加载端接基准电压,所述N型第二晶体管接在电源V_DD与N型第一晶体管的偏置电压加载端之间,构成负反馈电路。本发明对电源、工艺角和温度变化不敏感,时钟频率稳定,电路功耗低,结构简单,成本低。
搜索关键词: 一种 具有 稳定 功耗 时钟 电路
【主权项】:
一种具有高稳定度的超低功耗时钟电路,包括时钟振荡电路和供电电路,所述供电电路为时钟振荡电路供电,其特征在于:所述供电电路包括N型第一晶体管和第二晶体管、P型第三晶体管和第一电容,所述N型第一晶体管和P型第三晶体管串联后接在电源V_DD与地之间,所述N型第一晶体管的偏置电压加载端接时钟振荡电路的电源输入端,所述P型第三晶体管的偏置电压加载端接基准电压,所述电源V_DD与N型第一晶体之间接入第三基准电流,所述第一电容与N型第一晶体管和P型第三晶体管并联,所述N型第二晶体管接在电源V_DD与N型第一晶体管的偏置电压加载端之间,构成负反馈电路,所述N型第二晶体管的偏置电压加载端接在第三基准电流和N型第一晶体管之间的节点。
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