[发明专利]闪存结构的制造方法有效
申请号: | 201610052576.1 | 申请日: | 2016-01-26 |
公开(公告)号: | CN105428319B | 公开(公告)日: | 2018-06-29 |
发明(设计)人: | 曹子贵 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | H01L21/762 | 分类号: | H01L21/762;H01L27/11517 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 吴敏 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | 一种闪存结构的制造方法,包括:提供包括第一区域的衬底;在衬底上依次形成浮置栅层和硬掩膜层;在硬掩膜层、浮置栅层和衬底中形成沟槽,包括第一区域的第一沟槽;在第一沟槽中填充隔离材料;以硬掩膜层作为停止层,研磨去除高于硬掩膜层的隔离材料,在第一沟槽形成具有第一厚度值的第一初始隔离结构;根据第一初始隔离结构的目标厚度值与第一厚度值的差值进行动态调节刻蚀,去除部分厚度的第一初始隔离结构形成第一隔离结构。本发明根据目标厚度值与第一厚度值的差值进行动态调节刻蚀,去除部分厚度的第一初始隔离结构,形成第一隔离结构,并使差值减小,避免引起第一隔离结构两侧衬底的拐角处暴露在外的问题,进而提高闪存结构的电学性能。 | ||
搜索关键词: | 隔离结构 硬掩膜层 衬底 闪存结构 去除 第一区域 动态调节 隔离材料 浮置栅 刻蚀 电学性能 沟槽形成 研磨 拐角处 停止层 减小 填充 制造 暴露 | ||
【主权项】:
1.一种闪存结构的制造方法,其特征在于,包括:提供衬底,所述衬底包括用于形成存储单元的第一区域、用于形成外围器件的第三区域以及位于所述第一区域和第三区域之间且用于形成隔离区的第二区域;在所述衬底上形成浮置栅层;在所述浮置栅层上形成硬掩膜层;在所述硬掩膜层、浮置栅层和衬底中形成沟槽,所述沟槽包括位于所述第一区域的第一沟槽、位于所述第二区域的第二沟槽以及位于所述第三区域的第三沟槽;在所述第一沟槽、第二沟槽和第三沟槽中填充隔离材料;以所述硬掩膜层作为停止层,通过平坦化工艺去除高于所述硬掩膜层的隔离材料,在所述第一沟槽内形成第一初始隔离结构,在所述第二沟槽内形成第二隔离结构,在所述第三沟槽内形成第三隔离结构,所述第一初始隔离结构具有第一厚度值;根据所述第一初始隔离结构的目标厚度值与所述第一厚度值的差值,获得第二厚度值;根据所述第二厚度值进行动态调节刻蚀,去除部分厚度的所述第一初始隔离结构,形成第一隔离结构,使所述第一隔离结构的厚度值与目标厚度值的差值减小;形成所述第一隔离结构后,去除所述硬掩膜层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造