[发明专利]用于高压器件的低成本的掩膜还原方法及器件有效

专利信息
申请号: 201610074498.5 申请日: 2016-02-02
公开(公告)号: CN105931983B 公开(公告)日: 2019-01-04
发明(设计)人: 秀明土子;雷燮光 申请(专利权)人: 万国半导体股份有限公司
主分类号: H01L21/768 分类号: H01L21/768;H01L27/04
代理公司: 上海信好专利代理事务所(普通合伙) 31249 代理人: 张静洁;包姝晴
地址: 美国加利福尼亚9408*** 国省代码: 美国;US
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摘要: 发明提出了一种半导体器件及其制备方法,该器件包括P‑型半导体衬底、在半导体衬底上方的N‑型阱、在N‑型阱中被一个或多个P‑型隔离结构隔开的P型区、以及在P‑型区下方被隔离结构隔开的N‑型穿通阻挡层。与N‑型阱相比,穿通阻挡层重掺杂。P‑型区在两个隔离结构之间的宽度等于或小于N‑型穿通阻挡层的宽度。半导体器件可以是双极晶体管、CMOS器件或DMOS器件。利用本发明的技术,任意器件组合可以集成在一个单独芯片上。
搜索关键词: 用于 高压 器件 低成本 还原 方法
【主权项】:
1.一种半导体器件,其特征在于,包括:一个第一导电类型的半导体衬底;一个第二导电类型的第一层,在第一导电类型的半导体衬底上方;一个或多个第一导电类型的隔离结构,在一部分第二导电类型的第一层中,其中配置一个或多个隔离结构,使形成在第二导电类型的第一层中的一个第一导电类型的区域隔离,其中一个或多个隔离结构向深处延伸,穿过第二导电类型的第一层,到达第一导电类型的半导体衬底;其中,第一导电类型的区域通过第一阱掩膜制备,并在制备后使第一阱掩膜的开口尺寸增大,以及一个第二导电类型的穿通阻挡层,利用开口尺寸增大了的同一个第一阱掩膜制备,在第一导电类型的区域下方,被第一导电类型的一个或多个隔离结构隔开;其中与第二导电类型的第一层相比,第二导电类型的穿通阻挡层重掺杂,其中第一导电类型的区域宽度等于或小于第二导电类型的穿通阻挡层宽度。
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