[发明专利]时钟生成电路有效
| 申请号： | 201610146047.8 | 申请日： | 2016-03-15 |
| 公开（公告）号： | CN105991114B | 公开（公告）日： | 2019-03-08 |
| 发明（设计）人： | 杨天骏;林志昌;黃明杰 | 申请（专利权）人： | 台湾积体电路制造股份有限公司 |
| 主分类号： | H03K5/151 | 分类号： | H03K5/151 |
| 代理公司： | 北京德恒律治知识产权代理有限公司 11409 | 代理人： | 章社杲;李伟 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 本发明的实施例提供一种时钟生成电路，包括两相不重叠时钟生成电路、反相器和延时电路。两相不重叠时钟生成电路被配置为：基于非反相时钟信号和反相时钟信号来生成第一相位时钟信号和第二相位时钟信号。在时钟周期内的第一时间段和第二时间段期间，第一相位时钟信号和第二相位时钟信号对应于相同的逻辑值。反相器被配置为基于输入时钟信号来生成反相时钟信号。延时电路被配置为基于输入时钟信号来生成非反相时钟信号。延时电路具有足以使第一时间段和第二时间段之间的差值小于预定容差的预定延时。 | ||
| 搜索关键词： | 时钟 生成 电路 | ||
【主权项】：
1.一种时钟生成电路，包括：两相不重叠时钟生成电路，配置为基于非反相时钟信号和反相时钟信号来生成第一相位时钟信号和第二相位时钟信号，在时钟周期内的第一时间段和第二时间段期间，所述第一相位时钟信号和所述第二相位时钟信号对应于相同的逻辑值，并且在所述时钟周期的剩余时间段期间，所述第一相位时钟信号和所述第二相位时钟信号对应于不同的逻辑值；反相器，配置为基于输入时钟信号来生成所述反相时钟信号；以及延时电路，配置为基于所述输入时钟信号来生成所述非反相时钟信号，所述延时电路具有足以使所述第一时间段和所述第二时间段之间的差值小于预定容差的预定延时，所述延时电路包括：第二P型晶体管，具有第三沟道宽度与沟道长度(W/L)比率；第二N型晶体管，具有第四沟道宽度与沟道长度(W/L)比率，其中，所述延时电路包括第二P型晶体管和第二N型晶体管，所述第二P型晶体管和所述第二N型晶体管并联电耦合在所述延时电路的输入端与所述延时电路的输出端之间。
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