[发明专利]一种抗SET的加固存储电路在审
| 申请号： | 201610203929.3 | 申请日： | 2016-04-05 |
| 公开（公告）号： | CN105913869A | 公开（公告）日： | 2016-08-31 |
| 发明（设计）人： | 张力彬 | 申请（专利权）人： | 浪潮电子信息产业股份有限公司 |
| 主分类号： | G11C7/24 | 分类号： | G11C7/24 |
| 代理公司： | 济南信达专利事务所有限公司 37100 | 代理人： | 李世喆 |
| 地址： | 250100 山东*** | 国省代码： | 山东;37 |
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| 摘要： | 本发明提供了一种抗SET的加固存储电路，包括：DICE型D触发电路和时钟电路；时钟电路为DICE型D触发电路提供时钟信号；其中，输入到DICE型D触发电路的时钟信号的抗SET脉冲宽度不小于设定的第一阈值，和，抗SET脉冲宽度差值不大于设定的第二阈值。根据本方案，由时钟电路向DICE型D触发电路提供时钟信号，通过保证输入到DICE型D触发电路的时钟信号的上升沿脉冲宽度和下降沿脉冲宽度均不小于设定的第一阈值，和，上升沿脉宽度冲和下降沿脉冲宽度之间的差值小于设定的第二阈值，从而可以根据实验模拟结果确定该加固存储电路提高了抗SET性能，进而降低了电路所受到SET的影响。 | ||
| 搜索关键词： | 一种 set 加固 存储 电路 | ||
【主权项】：
一种抗单粒子瞬变SET的加固存储电路，其特征在于，包括：DICE型D触发电路和时钟电路；所述时钟电路为所述DICE型D触发电路提供时钟信号；其中，输入到所述DICE型D触发电路的时钟信号的抗SET脉冲宽度不小于设定的第一阈值，和，抗SET脉冲宽度差值不大于设定的第二阈值。
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