[发明专利]一种面阵列无引脚CSP封装件及其制造方法有效
申请号: | 201610287943.6 | 申请日: | 2016-05-04 |
公开(公告)号: | CN105789072B | 公开(公告)日: | 2018-06-08 |
发明(设计)人: | 李习周;邵荣昌;王永忠;周金成;胡魁;慕蔚;张易勒 | 申请(专利权)人: | 天水华天科技股份有限公司 |
主分类号: | H01L21/60 | 分类号: | H01L21/60;H01L23/488 |
代理公司: | 甘肃省知识产权事务中心 62100 | 代理人: | 周立新 |
地址: | 741000 甘*** | 国省代码: | 甘肃;62 |
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摘要: | 一种面阵列无引脚CSP封装件及其制造方法,包括多个互不相连的上下表面均和有镍层的引出端;镍层上叠加有树脂层,并填充相邻引出端之间的上端空腔;树脂层上设有与镍层连通的多个镀铜通孔,镀铜通孔通过印刷线连通,粘贴有IC芯片;树脂层上有塑封体。刻蚀镀有镍层的铜合金薄片,铜合金薄片上叠加树脂层,在树脂层上制造多个连通镍层的镀铜通孔和多条印刷线,树脂层上粘贴IC芯片,塑封制得CSP封装件。该CSP封装件用树脂层作为中间的支撑层,通过印制线实现了封装电路的再布线,将封装器件的引出端呈面阵列分布在塑封体底部,使封装件能够在单位安装面积内能容纳更多的引出端子。 | ||
搜索关键词: | 树脂层 封装件 镍层 面阵列 引出端 镀铜 通孔 连通 塑封体 铜合金 印刷线 引脚 粘贴 叠加 制造 封装电路 封装器件 互不相连 上端空腔 上下表面 引出端子 印制线 再布线 支撑层 均和 刻蚀 塑封 填充 容纳 | ||
【主权项】:
一种面阵列无引脚CSP封装件,其特征在于,包括多个互不相连的引出端(1),引出端(1)的上表面和下表面均镀覆有镍层(6);位于引出端(1)上表面的镍层(6)上叠加有树脂层(2),树脂层(2)覆盖所有的位于引出端(1)上表面的镍层(6),并填充相邻引出端(1)之间的上端空腔(12);树脂层(2)上设有数量与引出端(1)数量相同的镀铜通孔(5),一个镀铜通孔(5)与一个引出端(1)上表面的镍层(6)连通,树脂层(2) 上表面设置有多条印制线(4),同一列引出端(1)上方的镀铜通孔(5)通过一条印刷线(4)连通,树脂层(2)上粘贴有IC芯片(8),IC芯片(8)通过键合丝(11)与印刷线(4)相连;树脂层(2)上设有塑封体(9),IC芯片(8)、键合丝(11)、印制线(4)和树脂层(2)均封装于塑封体(9)内;引出端(1)下部包覆有焊膏(3)。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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