[发明专利]基于FPGA的高吞吐量SHA‑1算法在审
| 申请号： | 201610372987.9 | 申请日： | 2016-05-31 |
| 公开（公告）号： | CN106100825A | 公开（公告）日： | 2016-11-09 |
| 发明（设计）人： | 莫小妮;袁结全;唐锐 | 申请（专利权）人： | 深圳市风云实业有限公司 |
| 主分类号： | H04L9/06 | 分类号： | H04L9/06 |
| 代理公司： | 成都正华专利代理事务所(普通合伙) 51229 | 代理人： | 李蕊 |
| 地址： | 518040 广东省深圳市福田区*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明提供一种基于FPGA的高吞吐量SHA‑1算法，包括以下步骤：S1、判断输入的消息数据的长度是否超过512bits；S2、如果输入的消息数据的长度超过512bits，对所述消息数据进行补位，补齐到长度为512的整数倍；S3、将补位后的消息数据分为多个数据块，每个数据块为512bits，并将每个数据块分为16个字，每个字为32bits；S4、将原始的迭代运算公式进行循环展开，形成循环展开结构；S5、确定流水线级数，由中间寄存器和所述循环展开结构构成流水线结构；S6、将每个字输入流水线结构，得到SHA‑1算法计算结果。本发明通过简化迭代运算，加入中间变量，达到缩短关键路径、提升计算速度的目的。并通过流水处理的方式，增大数据的处理量，进而提升吞吐量。 | ||
| 搜索关键词： | 基于 fpga 吞吐量 sha 算法 | ||
【主权项】：
基于FPGA的高吞吐量SHA‑1算法，其特征在于，包括以下步骤：S1、对输入的消息数据进行补位，并将补位后的消息数据分为多个512bits的数据块，将每个数据块分为16个32bits的字；S2、将原始的迭代运算公式进行循环展开，形成循环展开结构，并确定流水线级数，由中间寄存器和所述循环展开结构构成流水线结构；S3、将每个字输入所述流水线结构，得到SHA‑1算法计算结果。
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