[发明专利]一种高分辨率时钟相移架构与算法的实现方法在审
| 申请号： | 201610446166.5 | 申请日： | 2016-06-21 |
| 公开（公告）号： | CN106130543A | 公开（公告）日： | 2016-11-16 |
| 发明（设计）人： | 涂波;单悦尔;于宗光;胡凯 | 申请（专利权）人： | 中国电子科技集团公司第五十八研究所 |
| 主分类号： | H03L7/081 | 分类号： | H03L7/081;H03L7/085;H03L7/18 |
| 代理公司： | 总装工程兵科研一所专利服务中心 32002 | 代理人： | 杨立秋 |
| 地址： | 214035 *** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明涉及一种高分辨率时钟相移架构，包括：粗粒度时钟相位延迟链DELAY_LINE1，时钟相位选择器CLK_PS_MUX1，细粒度时钟相位延迟链FINE_DELAY1，粗粒度时钟相位鉴相器GENERAL_PD，细粒度时钟相位鉴相器FINE_PD，粗粒度时钟相位延迟链控制器GENERAL_CTRL和细粒度时钟相位延迟链控制器FINE_CTRL；同时，本发明提出一种新的算法，通过两次鉴相、计数器作差，求得输入时钟周期，再对输入时钟周期360等分，即可求得每1度对应的计数器的值，用户通过配置相应度数的数据给GENERAL_CTRL和FINE_CTRL就可以实现对时钟进行任意度数相位移动。 | ||
| 搜索关键词： | 一种 高分辨率 时钟 相移 架构 算法 实现 方法 | ||
【主权项】：
一种高分辨率时钟相移架构，其特征在于，包括：粗粒度时钟相位延迟链DELAY_LINE1，用于以低分辨率对时钟相位进行快速的移动；时钟相位选择器CLK_PS_MUX1，用于粗粒度时钟相位延迟链DELAY_LINE1上时钟相位的选择；细粒度时钟相位延迟链FINE_DELAY1，用于以高分辨率对时钟相位选择器CLK_PS_MUX1输出时钟相位进行精确的移动；粗粒度时钟相位鉴相器GENERAL_PD，用于检测粗粒度时钟相移时，目标相移时钟CLKOUT1的相位是否超过基准相移时钟CLKOUT0的相位；细粒度时钟相位鉴相器FINE_PD，用于检测细粒度时钟相移时，目标相移时钟CLKOUT1的相位是否超过基准相移时钟CLKOUT0的相位；粗粒度时钟相位延迟链控制器GENERAL_CTRL，用于接收粗粒度时钟相位鉴相器GENERAL_PD的输出信号或用户配置的数据DATA1，控制时钟相位选择器CLK_PS_MUX1；细粒度时钟相位延迟链控制器FINE_CTRL，用于接收细粒度时钟相位鉴相器FINE_PD的输出信号或用户配置的数据DATA2，控制细粒度时钟相位延迟链FINE_DELAY1。
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