[发明专利]基于静态分析的异步电路时序检查方法在审
| 申请号： | 201610455917.X | 申请日： | 2016-06-22 |
| 公开（公告）号： | CN106096171A | 公开（公告）日： | 2016-11-09 |
| 发明（设计）人： | 陶思敏;张恒 | 申请（专利权）人： | 深圳市紫光同创电子有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 北京汇泽知识产权代理有限公司 11228 | 代理人： | 张瑾 |
| 地址： | 518057 广东省深圳市南山区*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明提供一种基于静态分析的异步电路时序检查方法。所述方法包括：分析逻辑设计文件，建立时序图；读入时序约束文件，在所述时序图上建立时序约束；进行时序检查；当时序检查未发现异常情况时，在所述时序图上提取异步时序路径并进行分析，计算异步时序路径的延迟信息；根据所述异步时序路径的延迟信息以及库文件中器件要求的延时信息，计算时序余量信息，根据所述时序余量信息判断用户设计是否满足时序要求。本发明能够判断异步电路是否出现时序问题，为集成电路设计者提供参考，以保证设计质量。 | ||
| 搜索关键词： | 基于 静态 分析 异步 电路 时序 检查 方法 | ||
【主权项】：
一种基于静态分析的异步电路时序检查方法，其特征在于，包括：分析逻辑设计文件，建立时序图；读入时序约束文件，在所述时序图上建立时序约束；进行时序检查；当时序检查未发现异常情况时，在所述时序图上提取异步时序路径并进行分析，计算异步时序路径的延迟信息；根据所述异步时序路径的延迟信息以及库文件中器件要求的延时信息，计算时序余量信息，根据所述时序余量信息判断用户设计是否满足时序要求。
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