[发明专利]基于延迟链结构的时域放大器有效

专利信息
申请号: 201610493082.7 申请日: 2016-06-28
公开(公告)号: CN106059521B 公开(公告)日: 2019-05-07
发明(设计)人: 王小松;刘昱;张海英 申请(专利权)人: 中国科学院微电子研究所
主分类号: H03G3/20 分类号: H03G3/20;H03K23/00
代理公司: 中科专利商标代理有限责任公司 11021 代理人: 任岩
地址: 100029 *** 国省代码: 北京;11
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摘要: 发明公开了一种基于延迟链结构的时域放大器,该时域放大器包括时间采样保持单元、时间放大单元、触发器和异或门,其中:时间采样保持单元,由使能高电平信号触发,用于实现对输入脉冲信号Tin的采样和保持;时间放大单元,用于对采样的和保持的输入脉冲信号Tin进行线性放大;触发器,由输入脉冲信号Tin的下降沿触发;异或门,用于对时间放大单元输出与触发器的输出进行异或逻辑运算,将高电平转为低电平,实现输入脉冲信号Tin的M倍放大。本发明所提供的基于延迟链结构的时域放大器可以实现线性、精确和可以动态设定的时间放大增益值。其应用在TDC中,可使得TDC的转换速率获得提高。
搜索关键词: 基于 延迟 链结 时域 放大器
【主权项】:
1.一种基于延迟链结构的时域放大器,其特征在于,该时域放大器包括时间采样保持单元、时间放大单元、触发器和异或门,其中:时间采样保持单元,由使能高电平信号触发,用于实现对窄脉冲信号Tin的采样和保持;时间放大单元,用于对采样的和保持的窄脉冲信号Tin进行线性放大;触发器,由窄脉冲信号Tin的下降沿触发;异或门,用于对时间放大单元输出与触发器的输出进行异或逻辑运算,将高电平转为低电平,实现窄脉冲信号Tin的M倍放大,M为任意一个正整数值;其中,所述时间放大单元具有第二延迟链和计数器,该第二延迟链由多个延迟单元串联而成,所述时间放大单元将所述时间采样保持单元第一延迟链中的窄脉冲信号Tin复制到时间放大单元的第二延迟链中,通过设定计数器的计数值M,使窄脉冲信号Tin在时间放大单元的第二延迟链中循环M次,从而使得宽脉冲信号Tout脉冲宽度是窄脉冲信号Tin脉冲宽度的M倍;窄脉冲信号Tin的下降沿触发所述触发器输出B为高电平,此时计数器输出A为低电平,异或门输出由低电平转为高电平;当计数器计数满时,产生进位输出A为高电平,异或门输出由高电平变为低电平。
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