[发明专利]非易失性FPGA片上数据流文件的保密系统及解密方法有效
| 申请号： | 201610534391.4 | 申请日： | 2016-07-07 |
| 公开（公告）号： | CN106201352B | 公开（公告）日： | 2019-11-29 |
| 发明（设计）人： | 高三达;朱璟辉;蒂瓦卡·乔珀拉 | 申请（专利权）人： | 广东高云半导体科技股份有限公司 |
| 主分类号： | G06F3/06 | 分类号： | G06F3/06 |
| 代理公司： | 44454 深圳市朝闻专利代理事务所(普通合伙) | 代理人： | 谭育华<国际申请>=<国际公布>=<进入 |
| 地址： | 510700 广东省广*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明提供一种非易失性FPGA片上数据流文件的保密系统及解密方法，系统配置非易失性的存储器模块只允许全擦写操作，全擦写操作完成后非易失性的存储器模块进入初始状态，初始状态下对非易失性的存储器模块的操作才有效，进而在非易失性的存储器模块中设置加密区域单元，只有在初始状态下写入加密区域单元的解密的数据才能使非易失性的存储器模块可读，从而完成对系统的解密，这样就大大提高的了保密精度。 | ||
| 搜索关键词： | 非易失性 fpga 数据流 文件 保密 系统 解密 方法 | ||
【主权项】：
1.一种非易失性FPGA片上数据流文件的保密系统，其特征在于，包括用户自定义可编程逻辑模块、非易失性的存储器模块，编程控制模块、编程I/O口和用户I/O口；所述用户自定义可编程逻辑模块、非易失性的存储器模块和编程I/O口均与编程控制模块连接，用户I/O口与用户自定义可编程逻辑模块连接；所述非易失性的存储器模块中包括加密区域单元；非易失性的存储器模块在默认状态下，只允许全擦写操作，全擦写操作完成后非易失性的存储器模块进入初始状态，只有在初始状态下写入加密区域单元的解密的数据才能使非易失性的存储器模块可读，从而完成对系统的解密。/n
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