[发明专利]视频流像素级数据随机实时访问的存储器及存储方法有效

专利信息
申请号: 201610599212.5 申请日: 2016-07-26
公开(公告)号: CN106201363B 公开(公告)日: 2023-01-31
发明(设计)人: 张行;应三丛;范昌平;王兴政 申请(专利权)人: 四川大学
主分类号: G06F3/06 分类号: G06F3/06;G06F5/16;G06F12/0875;G06F12/0879;G06T1/00;G06T1/60
代理公司: 成都睿道专利代理事务所(普通合伙) 51217 代理人: 潘育敏;刘金蓉
地址: 610064 四*** 国省代码: 四川;51
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摘要: 视频流像素级数据随机实时访问的存储器及存储方法。存储器为两组QDR2存储模块组合扩展构成,每一组有两块QDR2存储模块。在每一组存储模块组合中,设置有图像数据奇行存储单元和偶行存储单元。图像数据在两组存储单元采用乒乓缓存的方式分别存储一半奇帧,一半偶帧并行工作,实现视频流实时处理。每次图像数据访问按两个数据突发方式读写的方式进行,拼接成每个像素数据结构带宽为24bit的3个像素数据结构。在写入数据过程中,除每行的第一次写除外,每次写都将上次的最后一个像素重复写一次。本发明利用每次冗余存储的一个像素数据,实现用一个像素时钟周期,同时读写4个像素值,大幅降低视频流数据随机实时访问的时钟周期,降低存储器空间占用和费用。
搜索关键词: 视频 像素 级数 随机 实时 访问 存储器 存储 方法
【主权项】:
一种视频流像素级数据随机实时访问的存储器,其特征在于:视频流像素级数据随机实时访问的存储器基于高性能图像处理平台应用,平台以FPGA为控制器;存储器为相同结构的两组模块组合组成,每一组模块采用两块相同的数据突发读写Burst 2的QDR2存储模块组合扩展构成模块组合,两块QDR2存储模块通过地址总线组、时钟信号线组、控制信号线组和数据总线组并联在一起,控制信号对两块QDR2存储模块同时进行控制;在每一组存储模块组合中,设置结构完全相同、专用于每次图像数据访问按两个数据突发方式读写的存储单元;存储器的两组存储模块组合分别按照图像数据相邻的两个奇行、偶行设置为奇行存储单元(QDR2_1)和偶行存储单元(QDR2_2),分别在(QDR2_1)中存储奇行数据,在(QDR2_2)中存储偶行数据。
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