[发明专利]一种大规模数字集成电路时钟网格分布方法有效
| 申请号： | 201610814198.6 | 申请日： | 2016-09-09 |
| 公开（公告）号： | CN106446366B | 公开（公告）日： | 2019-09-10 |
| 发明（设计）人： | 路崇;谭洪舟;吴华灵;陆许明;陈凡;李浪兴 | 申请（专利权）人： | 广东顺德中山大学卡内基梅隆大学国际联合研究院;中山大学花都产业科技研究院;中山大学 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 广州粤高专利商标代理有限公司 44102 | 代理人： | 林丽明 |
| 地址： | 52830*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明提供一种大规模数字集成电路时钟网格分布方法，该方法将电路划分为若干个物理相邻的时钟域，使每个时钟域与周围四个时钟域相邻；之后在每个时钟域内设置一个延迟可调的延迟补偿单元，并在每两个相邻的时钟域之间设置一个相位检测单元；对各个时钟域之间的相位关系进行探测，得到向量f(N,S,W,E)代表一个时钟域与其四个相邻时钟域的相位关系对比结果，并得到向量g(N,S,W,E)表示时钟域与其相邻其他时钟域之间的相位差在时域上是否大于预先设定的阈值g；利用得到的两个向量通过最小邻域偏斜算法对延迟补偿单元进行调整，使得每两个相邻时钟区域之间的相位差都将小于g就完成电路的网格分布。 | ||
| 搜索关键词： | 一种 大规模 数字集成电路 时钟 网格 分布 方法 | ||
【主权项】：
1.一种大规模数字集成电路时钟网格分布方法，其特征在于，包括以下步骤：S1：将电路划分为若干个物理相邻的时钟域，每个时钟域与周围四个时钟域相邻；S2：在每个时钟域内设置一个延迟可调的延迟补偿单元CU，并在每两个相邻的时钟域之间设置一个相位检测单元PDU；S3：对各个时钟域之间的相位关系使用PDU进行探测，并获得相位关系结果，以向量f(N,S,W,E)代表一个时钟域与其四个相邻时钟域的相位关系对比结果；S4：相位检测单元PDU探测时钟域与其相邻其他时钟域之间的相位差在时域上是否大于预先设定的阈值t，以g(N,S,W,E)进行表示；S5：利用向量f(N,S,W,E)和向量g(N,S,W,E)通过最小邻域偏斜算法对延迟补偿单元CU进行调整，使得每两个相邻时钟区域之间的相位差都将小于t就完成电路的网格分布，具体过程是：所述延迟补偿单元CU由控制逻辑单元、移位寄存器和可变延迟路径单元构成，控制逻辑单元根据时钟域接收到的向量f(N,S,W,E)和g(N,S,W,E)对移位控制器进行操作，移位控制器的位数为d，调节步长为s，其中s<t。
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