[发明专利]非易失性存储装置有效
| 申请号： | 201610866285.6 | 申请日： | 2016-09-30 |
| 公开（公告）号： | CN107039075B | 公开（公告）日： | 2021-06-22 |
| 发明（设计）人： | 见谷真;林田广宣 | 申请（专利权）人： | 艾普凌科有限公司 |
| 主分类号： | G11C16/10 | 分类号： | G11C16/10 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 何欣亭;付曼 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
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| 摘要： | 提供具备噪声耐受性高的防误写入功能的非易失性存储装置。采用了这样的结构：具备在时钟端子并联连接的开关和噪声滤波器电路，当时钟脉冲监视器电路比较从时钟端子输入的时钟数和规定数而检测到时钟数的异常时，切换到使开关截止而使噪声滤波器电路有效的噪声对策模式。 | ||
| 搜索关键词： | 非易失性 存储 装置 | ||
【主权项】：
一种非易失性存储装置，其特征在于，具备：在时钟端子并联连接的第一开关和第一噪声滤波器电路；根据从数据输入端子输入的数据对指令进行解码的指令解码器电路；比较从所述时钟端子输入的时钟数和规定数而检测时钟数的异常、若检测到异常则输出异常检测信号的时钟脉冲监视器电路；接受所述异常检测信号而设置异常检测标志的时钟脉冲监视器寄存器；将所述异常检测标志向外部输出的输出电路；以及按照所述异常检测标志切换第一状态和第二状态的模式选择电路，所述第一状态是所述第一开关导通而所述第一噪声滤波器电路无效，所述第二状态是所述第一开关截止而所述第一噪声滤波器电路有效，所述异常检测标志被设置后的数据读取期间为所述第二状态。
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