[发明专利]一种宽带捷变低相位噪声频率综合发生器有效

专利信息
申请号: 201610987603.4 申请日: 2016-11-10
公开(公告)号: CN106571817B 公开(公告)日: 2019-11-05
发明(设计)人: 石玉;邓迅;刘汉子;张玮 申请(专利权)人: 电子科技大学
主分类号: H03L7/18 分类号: H03L7/18
代理公司: 电子科技大学专利中心 51203 代理人: 甘茂
地址: 611731 四川省成*** 国省代码: 四川;51
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摘要: 发明属于频率综合发生器技术,具体提供一种宽带捷变低相位噪声频率综合发生器包括:高稳晶振、下变频混频锁相环模块、预置牵引模块和控制模块,其中下变频混频锁相环模块采用粗变频和细变频两次下变频结构,从而在小体积下,实现更高的频率输出和低相位噪声;同时,预置牵引模块完成对于VCO的牵引和粗调谐,从而避免了错锁;并且,锁相环的锁定速度明显提高,实现了捷变。综上,本发明的目的在于提供一种宽带捷变低相位噪声频率综合发生器,能够实现低相位噪声、小步进、宽带宽和捷变。
搜索关键词: 一种 宽带 捷变低 相位 噪声 频率 综合 发生器
【主权项】:
1.一种宽带捷变低相位噪声频率综合发生器,包括:高稳晶振、下变频混频锁相环模块、预置牵引模块和控制模块,所述高稳晶振输出经过下变频混频锁相模块产生频率输出作为频率综合器输出;所述预置牵引模块检测频率综合器输出的频率、并将频率信息传输至控制模块,同时接收控制模块返回控制信号,根据控制信号提供预置电压对下变频混频锁相环模块的输出频率进行牵引;控制模块接收外部控制信息及预置牵引模块返回频率信息,控制下变频混频锁相环模块与预制牵引模块;其特征在于,所述下变频混频锁相环模块包括:4个功分器,倍频器,DDS,锁相环,环路滤波器,加法器,VCO,2个混频器,2个对称的带通滤波器;高温晶振输出经过第一功分器功分两路,其中一路作为锁相环的参考输入,另一路经过倍频器产生高频信号,所述高频信号经过第二功分器功分两路,其中一路与第一混频器的射频输入相连,第二功分器的另一路则作为DDS的输入,DDS的输出与第二混频器的本振端相连;锁相环的输出经过环路滤波后,与加法器的一个输入相连,加法器的另一个输入连接预置电压,加法器的输出与VCO的输入相连;VCO的输出与第一混频器的本振端相连;第一混频器的输出经过第三功分器后分别与所述2个对称的带通滤波器相连,第一带通滤波器选择出下变频频率,输出至第二混频器作为射频输入;第二带通滤波器选择出上变频频率,输出至第四功分器功分两路,其中一路输出作为频率综合器的输出,另一路则输出至预置牵引模块;第二混频器的输出作为鉴相的射频输入反馈至锁相环。
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