[发明专利]一种用于求解微分方程的硬件加速装置及加速方法在审
| 申请号： | 201611088172.4 | 申请日： | 2016-12-01 |
| 公开（公告）号： | CN106527999A | 公开（公告）日： | 2017-03-22 |
| 发明（设计）人： | 姚小城;殷进勇;刘煜;王洋;吴建鲁;李毅;陶峥嵘;董海祥;王永;李小亮 | 申请（专利权）人： | 中国船舶重工集团公司第七一六研究所 |
| 主分类号： | G06F3/06 | 分类号： | G06F3/06;G06F9/50;G06F13/16;G06F17/13 |
| 代理公司： | 南京理工大学专利中心32203 | 代理人： | 马鲁晋 |
| 地址： | 222000 *** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开了一种用于求解微分方程的硬件加速装置，由输入输出缓存模块、串并转换模块和基于龙哥库塔的硬件加速模块组成。输入输出缓存模块主要用于与主控直接交互数据的缓存，加速单元与主控之间的所有数据均通过输入输出缓存交互。串并/并串转换模块主要是负责将输入缓存的读出的数据根据需要多种并行输出，将硬件加速模块的并行输出数据转换为串行数据。基于龙哥库塔的硬件加速模块主要负责实现微分方程求解的硬件加速。该用于求解微分方程的硬件加速装置通过提出通用的计算架构，结合FPGA局部可重构特性，通过对核心计算单元的灵活配置，实现对微分方程组求解的硬件加速的通用化，从而有效地满足各种微分方程组快速求解的应用需求。 | ||
| 搜索关键词： | 一种 用于 求解 微分方程 硬件加速 装置 加速 方法 | ||
【主权项】：
一种用于求解微分方程的硬件加速装置，其特征在于，包括输入缓存模块、输出缓存模块、串并转换模块、并串转换模块和基于龙哥库塔的硬件加速单元；输入缓存模块、输出缓存模块中缓存的数据位宽与总线位宽匹配，输入缓存模块与串并转换模块相连，输出缓存模块与并串转换模块相连，串并转换模块的输出与基于龙哥库塔的硬件加速单元相连，提供微分方程计算所需的所有数据，基于龙哥库塔的硬件加速单元的输出与并串转换模块相连，将计算结果输出到并串转换模块；其中输入缓存模块通过串并转换模块与基于龙哥库塔的硬件加速单元进行信息交互，输出缓存模块通过并串转换模块和基于龙哥库塔的硬件加速单元进行信息交互，输入缓存模块、输出缓存模块用于与主控单元之间交互数据的缓存，基于龙哥库塔的硬件加速单元与主控单元之间的所有数据均通过输入输出缓存模块交互；所述串并转换模块将输入缓存读出的数据进行并行输出给硬件加速模块，并串转换模块将基于龙哥库塔的硬件加速模块的并行输出数据转换为串行数据；基于龙哥库塔的硬件加速模块用于实现微分方程求解的硬件加速。
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