[发明专利]一种时钟产生电路在审
| 申请号： | 201611249220.3 | 申请日： | 2016-12-29 |
| 公开（公告）号： | CN108259025A | 公开（公告）日： | 2018-07-06 |
| 发明（设计）人： | 方海彬;刘铭 | 申请（专利权）人： | 北京兆易创新科技股份有限公司;合肥格易集成电路有限公司 |
| 主分类号： | H03K3/012 | 分类号： | H03K3/012 |
| 代理公司： | 北京润泽恒知识产权代理有限公司 11319 | 代理人： | 苏培华 |
| 地址： | 100083 北京市海淀*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明实施例提供一种时钟产生电路，包括驱动电路、交叉耦合电路和输出模块，其中，驱动电路包括：第一反相器，第一反相器的输入端接收时钟输入信号，第一反相器的输出端与输出模块的控制端相连；第二反相器，第二反相器的输出端与交叉耦合电路的第一控制端相连；延迟模块，延迟模块的输入端分别与第一反相器的输出端和输出模块的控制端相连，延迟模块的输出端分别与交叉耦合电路的第二控制端和第二反相器的输入端相连，延迟模块用于对第一反相器的输出信号进行延迟。本发明实施例可以有效降低时钟产生电路的功耗。 | ||
| 搜索关键词： | 反相器 延迟模块 控制端 输出端 交叉耦合电路 时钟产生电路 输出模块 输入端 驱动电路 接收时钟 输出信号 功耗 延迟 | ||
【主权项】：
1.一种时钟产生电路，其特征在于，包括驱动电路、交叉耦合电路和输出模块，其中，所述驱动电路包括：第一反相器，所述第一反相器的输入端接收时钟输入信号，所述第一反相器的输出端与所述输出模块的控制端相连；第二反相器，所述第二反相器的输出端与所述交叉耦合电路的第一控制端相连；延迟模块，所述延迟模块的输入端分别与所述第一反相器的输出端和所述输出模块的控制端相连，所述延迟模块的输出端分别与所述交叉耦合电路的第二控制端和所述第二反相器的输入端相连，所述延迟模块用于对所述第一反相器的输出信号进行延迟。
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