[实用新型]一种基于相位累加器的分数分频器有效
| 申请号： | 201620218146.8 | 申请日： | 2016-03-21 |
| 公开（公告）号： | CN205490487U | 公开（公告）日： | 2016-08-17 |
| 发明（设计）人： | 刘晓强;李毅;陈松 | 申请（专利权）人： | 北京东方惠尔图像技术有限公司 |
| 主分类号： | H03L7/18 | 分类号： | H03L7/18 |
| 代理公司： | 北京东方汇众知识产权代理事务所(普通合伙) 11296 | 代理人： | 张淑贤 |
| 地址： | 100176 北京市*** | 国省代码： | 北京;11 |
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| 摘要： | 本实用新型公开了一种基于相位累加器的分数分频器，包括：频率控制字模块，用于确定相位累加器每次相位的递增量；N位相位累加器，与所述频率控制字模块相连，用于在系统时钟的触发下进行相位的累加，并把累加的相位输出；分频电路，与所述N位相位累加器相连，把所述N位相位累加器输出的相位与预设的值比较，实现占空比可调的分频时钟。本实用新型中相位累加器的位数N确定后，根据分频时钟和系统时钟的关系可以计算出频率控制字的值，频率控制字决定相位累加器的相位递增量，分频电路根据相位累加器输出的相位来输出分频时钟，可以产生占空比可调、分频比在2N到1/2之间的时钟，输出的分频时钟具有精度高、噪声小、相位抖动小的优点。 | ||
| 搜索关键词： | 一种 基于 相位 累加器 分数 分频器 | ||
【主权项】：
一种基于相位累加器的分数分频器，包括：频率控制字模块，用于确定相位累加器每次相位的递增量；N位相位累加器，与所述频率控制字模块相连，用于在系统时钟的触发下进行相位的累加，并把累加的相位输出；分频电路，与所述N位相位累加器相连，把所述N位相位累加器输出的相位与预设的值比较。
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