[实用新型]一种基于FPGA的中断聚合装置有效
| 申请号： | 201620278156.0 | 申请日： | 2016-04-06 |
| 公开（公告）号： | CN205507744U | 公开（公告）日： | 2016-08-24 |
| 发明（设计）人： | 高计丰;朱雅泉 | 申请（专利权）人： | 福建星网智慧科技股份有限公司 |
| 主分类号： | G06F9/48 | 分类号： | G06F9/48 |
| 代理公司： | 福州市鼓楼区京华专利事务所(普通合伙) 35212 | 代理人： | 林晓琴 |
| 地址： | 361000 福建省厦门市*** | 国省代码： | 福建;35 |
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| 摘要： | 本实用新型提供了一种基于FPGA的中断聚合装置，包括FPGA单元，所述FPGA单元分别与一CPU以及复数个管理FXS接口的SLIC芯片连接；所述FPGA单元包括一中断检测单元和一模拟寄存器；所述中断检测单元用于根据配置中的中断检测参数每间隔时间检测来自SLIC芯片的中断是否有效，若是，则将所述中断对应的标志位的值置为1并写入模拟寄存器中，否则，清零所述模拟寄存器中该中断对应的标志位；所述模拟寄存器用于存储所述SLIC芯片的中断标志位；所述FPGA单元还用于接收来自SLIC芯片的中断以及用于在模拟寄存器中存在非零的标志位时向CPU输出中断信号。本实用新型实现中断集中检测，减少CPU逐个轮询造成的资源与时间的浪费，大大提高CPU响应速率。 | ||
| 搜索关键词： | 一种 基于 fpga 中断 聚合 装置 | ||
【主权项】：
一种基于FPGA的中断聚合装置，其特征在于：包括FPGA单元，所述FPGA单元分别与一CPU以及复数个管理FXS接口的SLIC芯片连接；所述FPGA单元包括一中断检测单元和一模拟寄存器；所述中断检测单元用于根据配置中的中断检测参数每间隔时间检测来自SLIC芯片的中断是否有效，若是，则将所述中断对应的标志位的值置为1并写入模拟寄存器中，否则，清零所述模拟寄存器中该中断对应的标志位；所述模拟寄存器用于存储所述SLIC芯片的中断标志位；所述FPGA单元还用于接收来自SLIC芯片的中断以及用于在模拟寄存器中存在非零的标志位时向CPU输出中断信号。
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