[实用新型]共模电平产生电路有效
| 申请号： | 201620355047.4 | 申请日： | 2016-04-26 |
| 公开（公告）号： | CN205584156U | 公开（公告）日： | 2016-09-14 |
| 发明（设计）人： | 连颖 | 申请（专利权）人： | 成都锐成芯微科技有限责任公司 |
| 主分类号： | H03K5/13 | 分类号： | H03K5/13 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 610041 四川省成都市*** | 国省代码： | 四川;51 |
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| 摘要： | 本实用新型公开了一种共模电平产生电路，包括第一时钟信号输入端、与所述第一时钟信号输入端输入的时钟信号反相的第二时钟信号输入端、与所述第二时钟信号输入端相连的场效应管、与所述第一时钟信号输入端及所述场效应管相连的第一电容、与所述场效应管及所述第一电容相连的第二电容及共模电平输出端，在所述第一时钟信号输入端输入的时钟信号为低电平信号时，所述共模电平输出端输出共模电平。本实用新型静态功耗为零，动态功耗与系统时钟频率成正比。 | ||
| 搜索关键词： | 电平 产生 电路 | ||
【主权项】：
一种共模电平产生电路，其特征在于：所述共模电平产生电路包括第一时钟信号输入端、与所述第一时钟信号输入端输入的时钟信号反相的第二时钟信号输入端、与所述第二时钟信号输入端相连的场效应管、与所述第一时钟信号输入端及所述场效应管相连的第一电容、与所述场效应管及所述第一电容相连的第二电容及共模电平输出端，在所述第一时钟信号输入端输入的时钟信号为低电平信号时，所述共模电平输出端输出共模电平。
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