[实用新型]时钟信号发生器电路有效
| 申请号： | 201620709338.9 | 申请日： | 2016-05-30 |
| 公开（公告）号： | CN206099920U | 公开（公告）日： | 2017-04-12 |
| 发明（设计）人： | D·马格诺尼 | 申请（专利权）人： | 意法半导体股份有限公司 |
| 主分类号： | H03K3/017 | 分类号： | H03K3/017 |
| 代理公司： | 北京市金杜律师事务所11256 | 代理人： | 王茂华,张宁 |
| 地址： | 意大利阿格*** | 国省代码： | 暂无信息 |
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| 摘要： | 根据本实用新型实用新型提供一种时钟信号发生器电路。时钟信号发生器电路被配置为生成从输入时钟信号得到的输出时钟信号，包括单稳态级，具有被设计为接收所述输入时钟信号的时钟输入端、被设计为接收控制信号的控制输入端以及被设计为供应所述输出时钟信号的输出端，所述输出时钟信号具有根据所述控制信号可变的占空比；以及反馈回路，可操作地耦合到所述单稳态级并且被配置为根据所述输出时钟信号的占空比的期望值和检测值生成所述控制信号。 | ||
| 搜索关键词： | 时钟 信号发生器 电路 | ||
【主权项】：
一种时钟信号发生器电路(10)，其特征在于，被配置为生成从输入时钟信号(ckin)得到的输出时钟信号(ckout)，包括：单稳态级(12)，具有被设计为接收所述输入时钟信号(ckin)的时钟输入端(12a)、被设计为接收控制信号(Sc)的控制输入端(12b)以及被设计为供应所述输出时钟信号(ckout)的输出端(12c)，所述输出时钟信号(ckout)具有根据所述控制信号(Sc)可变的占空比(d)；以及反馈回路(13)，可操作地耦合到所述单稳态级(12)并且被配置为根据所述输出时钟信号(ckout)的占空比(d)的期望值和检测值生成所述控制信号(Sc)。
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