[实用新型]一种用于大规模数据计算的核心模块有效
| 申请号： | 201620828991.7 | 申请日： | 2016-08-03 |
| 公开（公告）号： | CN206133362U | 公开（公告）日： | 2017-04-26 |
| 发明（设计）人： | 沈君健;畅国刚;高健飞;赵元成;许亮峰 | 申请（专利权）人： | 北京妙微科技有限公司 |
| 主分类号： | G06F1/16 | 分类号： | G06F1/16 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 100102 北京市朝*** | 国省代码： | 北京;11 |
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| 摘要： | 本实用新型公开了一种用于大规模数据计算的核心模块，包括一块核心板，所述核心板上设有ARM核、DSP核和FPGA核，所述ARM核连接有NANDFLASH存储器和DDR存储器，所述DSP核连接有DDR存储器，所述FPGA核连接有SPIFLASH存储器，所述ARM核连接有用于供电的电源管理芯片TPS65217C，所述DSP核连接有用于供电的电源管理芯片TPS650250。所述核心板上还设有用于连接其他底板的连接器J1和连接器J2。所述核心板采用8层板高密度设计，体积小巧，仅名片大小，集成了3个高速内核，分别负责数据采集、数据运算、UI界面处理等工作，5V供电，超低功耗，连接器引出资源丰富，便于底板设计，信号完整性设计，便于用户的稳定量产。 | ||
| 搜索关键词： | 一种 用于 大规模 数据 计算 核心 模块 | ||
【主权项】：
一种用于大规模数据计算的核心模块，包括一块核心板，其特征在于，所述核心板上设有ARM核、DSP核和FPGA核，所述ARM核连接有NANDFLASH存储器和DDR存储器，所述DSP核连接有DDR存储器，所述FPGA核连接有SPIFLASH存储器，所述ARM核连接有用于供电的电源管理芯片TPS65217C，所述DSP核连接有用于供电的电源管理芯片TPS650250；所述核心板上还设有用于连接其他底板的连接器J1和连接器J2；所述核心板采用8层板高密度设计。
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