[发明专利]使用双频电容耦合等离子体(CCP)以EUV抗蚀剂进行的沟槽和孔图案化在审
申请号: | 201680025639.2 | 申请日: | 2016-04-01 |
公开(公告)号: | CN107567650A | 公开(公告)日: | 2018-01-09 |
发明(设计)人: | 松本大宇;安德鲁·W·梅茨;扬妮克·弗尔普里尔;凯蒂·吕特克-李 | 申请(专利权)人: | 东京毅力科创株式会社 |
主分类号: | H01L21/027 | 分类号: | H01L21/027;H01L21/3105;H01L21/311;G03F7/20 |
代理公司: | 北京集佳知识产权代理有限公司11227 | 代理人: | 唐京桥,杜诚 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | 公开了一种用于蚀刻在基片上的抗反射涂层(604)的方法。基片(600)包括有机层(606)、设置在有机层(606)上方的抗反射涂层(604)以及设置在抗反射涂层(604)上方的光致抗蚀剂层(602)。该方法包括将光致抗蚀剂层(602)图案化以露出抗反射涂层(604)的非掩模部分;以及在抗反射涂层(604)的非掩模部分和图案化的光致抗蚀剂层(602)的非侧壁部分上选择性地沉积(608)含碳层(609)。该方法还包括蚀刻(610)基片(600),以去除含碳层(609)并且去除抗反射涂层(604)的非掩模部分的部分厚度,而不减小光致抗蚀剂层(602)的厚度。该方法还包括重复(612)选择性沉积(608)和蚀刻(610),至少直到抗反射涂层(604)的非掩模部分的完整厚度被去除为止,以露出下面的有机层(606)。 | ||
搜索关键词: | 使用 双频 电容 耦合 等离子体 ccp euv 抗蚀剂 进行 沟槽 图案 | ||
【主权项】:
一种用于蚀刻穿透基片上的抗反射涂层的方法,包括:在所述基片上形成膜堆叠,所述膜堆叠包括:下面的有机层;抗反射涂层,其设置在所述下面的有机层上方;以及光致抗蚀剂层,其设置在所述抗反射涂层上方;使所述光致抗蚀剂层图案化,以露出所述抗反射涂层的非掩模部分;在所述抗反射涂层的非掩模部分和图案化的光致抗蚀剂层的非侧壁部分上选择性地沉积含碳层;蚀刻所述膜堆叠,以去除所述含碳层并且去除所述抗反射涂层的非掩模部分的部分厚度,而不减小所述光致抗蚀剂层的厚度;以及重复所述选择性沉积和蚀刻,至少直到所述抗反射涂层的非掩模部分的完整厚度被去除为止,以露出所述下面的有机层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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