[发明专利]具有比特级确收和纠错的串行接口在审
| 申请号： | 201680035073.1 | 申请日： | 2016-06-15 |
| 公开（公告）号： | CN107750359A | 公开（公告）日： | 2018-03-02 |
| 发明（设计）人： | L·J·米什拉;R·韦斯特费尔特;G·威利 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | G06F13/42 | 分类号： | G06F13/42 |
| 代理公司： | 上海专利商标事务所有限公司31100 | 代理人： | 周敏,陈炜 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 公开了一种将每个比特传输划分成确收阶段、纠错阶段、以及传输阶段的逐比特纠错技术。 | ||
| 搜索关键词： | 具有 特级 纠错 串行 接口 | ||
【主权项】：
一种方法，包括：在过采样时钟的第一组循环期间，对传送引脚的电压进行采样以从具有耦合到所述传送引脚的接收引脚的接收方设备接收第一组电压采样；处理所述第一组电压采样以确定所述接收方设备是否正确地解码先前比特传输；响应于确定所述接收方设备不正确地解码了所述先前比特传输而在所述过采样时钟的第二组循环期间脉动所述传送引脚的电压以向所述接收方设备通知所述接收方设备不正确地解码了所述先前比特传输；以及在所述过采样时钟的第三组采样期间，在所述传送引脚上向所述接收方设备的所述接收引脚传送当前比特。
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