[发明专利]一种基于倍压整流电路实现的忆阻器等效电路有效

专利信息
申请号: 201710073415.5 申请日: 2017-02-10
公开(公告)号: CN106782648B 公开(公告)日: 2023-06-16
发明(设计)人: 陈艳峰;谭斌冠;张波;丘东元 申请(专利权)人: 华南理工大学
主分类号: G11C13/00 分类号: G11C13/00
代理公司: 广州市华学知识产权代理有限公司 44245 代理人: 罗观祥
地址: 510640 广*** 国省代码: 广东;44
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摘要: 发明公开了一种基于倍压整流电路实现的忆阻器等效电路,包括n个相同的子模块,子模块由二极管和电解电容串联而成,第一子模块的第一输入端作为忆阻器等效电路的第一输入端,第一子模块的第二输入端作为忆阻器等效电路的第二输入端,第二子模块的第二输入端与第一子模块的第一输入端相连,第二子模块的第一输入端与第一子模块的中间端相连。依次类推,第n子模块的第二输入端与第n‑1子模块的第一输入端相连,第n子模块的第一输入端与第n‑1子模块的中间端相连。本电路利用二极管的受控源特性和电容的积分特性,使其符合忆阻器的特性;仅使用了二极管和电容,电路结构简单易实现,所用电路元件少,成本低,能够适用各种功率环境。
搜索关键词: 一种 基于 整流 电路 实现 忆阻器 等效电路
【主权项】:
一种基于倍压整流电路实现的忆阻器等效电路,其特征在于,所述忆阻器等效电路包括n个子模块,n为大于或等于2的正整数,所述子模块由二极管和电解电容串联而成,其中,二极管的正端为子模块的第一输入端,二极管的负端与电解电容的正端相连,此为子模块的中间端,电解电容的负端为子模块的第二输入端;第一子模块的第一输入端作为所述忆阻器等效电路的第一输入端,第一子模块的第二输入端作为所述忆阻器等效电路的第二输入端,第二子模块的第二输入端与第一子模块的第一输入端相连,第二子模块的第一输入端与第一子模块的中间端相连,依次类推,第n子模块的第二输入端与第n‑1子模块的第一输入端相连,第n子模块的第一输入端与第n‑1子模块的中间端相连。
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