[发明专利]一种全数字逻辑电路实现的真随机数发生器在审
| 申请号： | 201710176666.6 | 申请日： | 2017-03-23 |
| 公开（公告）号： | CN106708471A | 公开（公告）日： | 2017-05-24 |
| 发明（设计）人： | 陶育源 | 申请（专利权）人： | 成都为远信安电子科技有限公司 |
| 主分类号： | G06F7/58 | 分类号： | G06F7/58 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 610041 四川省成*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明公开了一种全数字逻辑单元实现的真随机数发生器。包括N路（N大于等于1）组合逻辑振荡环模块，异或逻辑模块以及采样处理逻辑模块。组合逻辑振荡环是由带有奇数次反向逻辑功能的组合逻辑单元串联而成，用于产生不规则的高频振荡信号；N路彼此不相关联的组合逻辑振荡环输出的高频信号经过异或逻辑模块两两异或后，合并产生一路不规则的高频振荡信号，之后送采样处理模块；采样处理模块是由从外部输入的采样时钟信号驱动的时序逻辑（触发器或锁存器）组成，用于采样异或逻辑模块产生的不规则高频信号，并对其进行随机性均衡及时序同步处理，之后输出。特点在于，所有功能模块都由集数字成电路标准逻辑单元搭建而成。 | ||
| 搜索关键词： | 一种 数字 逻辑电路 实现 随机数 发生器 | ||
【主权项】：
一种全数字逻辑实现的真随机数发生器，包括，N路（N大于等于1）组合逻辑振荡环模块，异或逻辑模块以及采样处理逻辑模块，其特征在于，所述随机数发生器所有组合部分全部都由数字集成电路的标准门单元和标准寄存器单元实现。
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