[发明专利]一种多核CPU发包的方法及装置有效

专利信息
申请号: 201710179363.X 申请日: 2017-03-23
公开(公告)号: CN107015942B 公开(公告)日: 2020-04-03
发明(设计)人: 任红军;胡军 申请(专利权)人: 杭州迪普科技股份有限公司
主分类号: G06F15/173 分类号: G06F15/173
代理公司: 北京博思佳知识产权代理有限公司 11415 代理人: 林祥
地址: 310051 浙江省杭*** 国省代码: 浙江;33
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摘要: 本申请提供一种多核CPU发包的方法及装置,应用于基于SMP架构的网络设备,所述方法包括:为多核CPU的各CPU静态分配唯一的下行内部通道;接收到所述转发芯片上送的报文时,提取该报文的报文特征;基于提取到的所述报文特征为所述报文分配目标CPU,并将该报文发送至所述目标CPU,以由所述目标CPU对该报文进行处理,并在处理完成后通过为所述目标CPU分配的下行内部通道向所述转发芯片返回处理结果。本申请实施例解决了相关技术中,CPU根据多个下行内部通道向转发芯片返回处理结果,而多个下行内部通道的接口的处理时延不同,导致报文乱序的问题。
搜索关键词: 一种 多核 cpu 发包 方法 装置
【主权项】:
一种多核CPU发包的方法,应用于基于SMP架构的网络设备,所述网络设备包括多核CPU和转发芯片,所述多核CPU与所述转发芯片之间存在多条下行内部通道,其特征在于,包括:为各CPU静态分配唯一的下行内部通道;接收到所述转发芯片上送的报文时,提取该报文的报文特征;基于提取到的所述报文特征为所述报文分配目标CPU,并将该报文发送至所述目标CPU,以由所述目标CPU对该报文进行处理,并在处理完成后通过为所述目标CPU分配的下行内部通道向所述转发芯片返回处理结果。
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