[发明专利]LDPC码的编码方法和编码器在审
| 申请号： | 201710303630.X | 申请日： | 2014-06-11 |
| 公开（公告）号： | CN107204777A | 公开（公告）日： | 2017-09-26 |
| 发明（设计）人： | 张文军;管云峰;何大治;徐胤;史毅俊;夏平建;王尧 | 申请（专利权）人： | 上海数字电视国家工程研究中心有限公司 |
| 主分类号： | H03M13/11 | 分类号： | H03M13/11 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 200125 上海市浦东*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明揭示了一种新型的结构化的重复累积型(S‑IRA)LDPC码字的编码方法及对应的编码器，该方法包括计算校验比特其中，j＝0,1,2,3,...,m‑1，表示在低密度奇偶校验矩阵中与pj所关联的信息比特，yj是信息比特的序号，根据如下公式得到其中，q＝320，m＝24000或者m＝11520,x表示参与奇偶校验比特累加的信息比特的地址。采用了本发明的技术方案，通过大量仿真模拟，找出了比现有技术更适用于HSS译码算法的一种LDPC码字的信息比特矩阵结构。 | ||
| 搜索关键词： | ldpc 编码 方法 编码器 | ||
【主权项】：
一种LDPC码的编码方法，其特征在于，包括以下步骤：计算校验比特其中，j＝0,1,2,3,...,m‑1，表示在低密度奇偶校验矩阵中与pj所关联的信息比特，yj是信息比特的序号，根据如下公式得到：其中，q＝320，m＝24000或者m＝11520,x表示参与奇偶校验比特累加的信息比特的地址，针对两个不同的m值，x的表分别为以下两个码表：码表1：码率7/12m＝24000,码长n＝57600码表2：码率12/15m＝11520,码长n＝57600
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