[发明专利]具有可编程存储器的集成电路及其制造方法有效
申请号: | 201710421886.0 | 申请日: | 2017-06-07 |
公开(公告)号: | CN107623002B | 公开(公告)日: | 2019-06-11 |
发明(设计)人: | X·张;S·萨达纳;Y·塞蒂亚万;Y·L·林;S·L·奇瓦 | 申请(专利权)人: | 新加坡商格罗方德半导体私人有限公司 |
主分类号: | H01L27/11521 | 分类号: | H01L27/11521;H01L29/788 |
代理公司: | 北京戈程知识产权代理有限公司 11314 | 代理人: | 程伟;王锦阳 |
地址: | 新加坡,*** | 国省代码: | 新加坡;SG |
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摘要: | 本发明涉及具有可编程存储器的集成电路及其制造方法,提供制造集成电路的方法及通过该方法所制造的集成电路。在例示性的实施例中,制造集成电路的方法包含在衬底内部形成第一及第二浅沟槽隔离,其中该第一及第二浅沟槽隔离具有初始浅沟槽高度。基部阱区为形成于该衬底中,其中该基部阱区是定位在该第一及第二浅沟槽隔离之间。栅极介电物是形成覆盖在该基部阱区上方,并且浮动栅极是形成覆盖在该栅极介电物上方。初始浅沟槽高度在该浮动栅极形成之后是降低至低于该初始浅沟槽高度的降低的浅沟槽高度。 | ||
搜索关键词: | 具有 可编程 存储器 集成电路 及其 制造 方法 | ||
【主权项】:
1.一种制造集成电路的方法,包括:形成第一浅沟槽隔离及第二浅沟槽隔离在衬底内部,其中,该第一浅沟槽隔离包括初始浅沟槽高度;形成基部阱区于该衬底中,其中,该基部阱区是定位在该第一浅沟槽隔离与该第二浅沟槽隔离之间;形成栅极介电物覆盖在该基部阱区上方并且延伸到该第一浅沟槽隔离和该第二浅沟槽隔离;形成浮动栅极覆盖在该栅极介电物上方,其中,该浮动栅极包括侧表面,且其中,该侧表面的一部分由该第一浅沟槽隔离覆盖而该侧表面的曝露部分曝露;以及在形成该浮动栅极之后,降低该初始浅沟槽高度至低于该初始浅沟槽高度的降低的浅沟槽高度。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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