[发明专利]一种FPGA中DSP乘法器的复用算法在审
| 申请号： | 201710541469.X | 申请日： | 2017-07-05 |
| 公开（公告）号： | CN107479855A | 公开（公告）日： | 2017-12-15 |
| 发明（设计）人： | 谢小东;潘飞 | 申请（专利权）人： | 电子科技大学 |
| 主分类号： | G06F7/523 | 分类号： | G06F7/523 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 611731 四川省成*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明提出了一种对FPGA中DSP slice乘法器的复用算法，当要进行乘法运算的因子相较于DSP乘法器的位宽较小时，将要进行运算的乘数按照一定的方式进行拼接，可以在一个时钟周期内使用一个DSP乘法器进行多组乘法运算，提高DSP的利用率，节省资源。 | ||
| 搜索关键词： | 一种 fpga dsp 乘法器 算法 | ||
【主权项】：
一种对FPGA中DSP slice乘法器的复用算法，当要进行乘法运算的因子相较于DSP乘法器的位宽较小时，将要进行运算的乘数按照一定的方式进行拼接，可以在一个时钟周期内使用一个DSP乘法器进行多组乘法运算。
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