[发明专利]应用于快闪存储器中的自适应LDPC码纠错码系统和方法有效
申请号: | 201710606541.2 | 申请日: | 2017-07-24 |
公开(公告)号: | CN107423161B | 公开(公告)日: | 2019-07-02 |
发明(设计)人: | 高美洲;孙大朋;郭泰 | 申请(专利权)人: | 山东华芯半导体有限公司 |
主分类号: | G06F11/10 | 分类号: | G06F11/10;G11C29/42 |
代理公司: | 济南泉城专利商标事务所 37218 | 代理人: | 赵玉凤 |
地址: | 250101 山东省济南市高新*** | 国省代码: | 山东;37 |
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摘要: | 本发明公开一种应用于快闪存储器中的自适应LDPC码纠错码系统和方法,可以提高闪存存储器的纠错码的纠错能力、保护存储数据的稳定性和提高闪存存储器使用寿命。本方法将LDPC码变为自适应的编、解码,改善了闪存存储控制器的适应性,也大大增强了闪存存储控制器的纠错能力,同时提高了闪存存储器使用寿命。 | ||
搜索关键词: | 应用于 闪存 中的 自适应 ldpc 纠错码 系统 方法 | ||
【主权项】:
1.一种应用于快闪存储器中的自适应LDPC码纠错码系统,包括主机、闪存存储控制器和闪存存储器,其特征在于:闪存存储控制器内设有自适应LDPC码解码器,自适应LDPC码解码器包括多级编码器、自适应调节器、硬判决解码器、软判决解码器、错误侦测器、判决器I、判决器II、数据处理器和脉冲恢复器,多级编码器连接于主机和闪存存储器之间,同时多级编码器的输入端与自适应调节器连接,用于根据自适应调节器进行相应的编码;硬判决解码器、软判决解码器的输入端均与自适应调节器、判决器I相连,并且软判决解码器的输入端与数据处理器相连,判决器I、数据处理器的另一端连接闪存存储器,硬判决解码器根据判决器I判断是否进行硬判决解码,并根据自适应调节器来判断进行解码的校验矩阵,软判决解码器根据判决器I判断是否进行软判决解码,通过获取数据处理器输出的校验位信息进行计算从而进行解码,根据自适应调节器判断进行解码的校验矩阵;硬判决解码器和软判决解码器的输出端均连接至判决器II,判决器II的输出端分别连接至自适应调节器、主机和错误侦测器,错误侦测器通过脉冲恢复器连接至闪存存储器,判断器II用于判断LDPC码纠错是否成功以及数据错误的位数,错误侦测器根据判决器II来判断解码失败,并利用脉冲恢复器来恢复闪存存储器中的数据错误。
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