[发明专利]一种数据信息排序方法、CPU端、FPGA端及系统有效
| 申请号： | 201710607627.7 | 申请日： | 2017-07-24 |
| 公开（公告）号： | CN107391088B | 公开（公告）日： | 2021-03-02 |
| 发明（设计）人： | 李雪雷 | 申请（专利权）人： | 苏州浪潮智能科技有限公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38;G06F15/78 |
| 代理公司： | 北京集佳知识产权代理有限公司 11227 | 代理人： | 罗满 |
| 地址： | 215100 江苏省苏州市吴*** | 国省代码： | 江苏;32 |
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| 摘要： | 本申请公开了一种数据信息排序方法，包括：CPU端执行从快速排序算法中分离出来的主程序算法；其中，所述CPU端执行主程序算法的过程，包括将待排序数据集传递到FPGA端，并向FPGA端发送排序启动控制命令；所述FPGA端在获取到所述排序启动控制命令后，执行从所述快速排序算法中分离出来的kernel程序算法，以对所述待排序数据集进行排序处理，得到相应的排序结果。本发明通过增加FPGA端来运行排序算法核心程序，突破原有的硬件限制，增加了运算速度，提高了工作效率。本发明还提供一种数据信息排序系统、CPU端、FPGA端，能够运行所述数据信息排序方法，同样能够增加运算速度，提高工作效率。 | ||
| 搜索关键词： | 一种 数据 信息 排序 方法 cpu fpga 系统 | ||
【主权项】：
一种数据信息排序方法，其特征在于，包括：CPU端执行从快速排序算法中分离出来的主程序算法；其中，所述CPU端执行主程序算法的过程，包括将待排序数据集传递到FPGA端，并向FPGA端发送排序启动控制命令；所述FPGA端在获取到所述排序启动控制命令后，执行从所述快速排序算法中分离出来的kernel程序算法，以对所述待排序数据集进行排序处理，得到相应的排序结果。
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