[发明专利]防止SEG损坏的3D NAND制备方法及获得的3D NAND闪存有效
申请号: | 201710726112.9 | 申请日: | 2017-08-22 |
公开(公告)号: | CN107658304B | 公开(公告)日: | 2019-01-01 |
发明(设计)人: | 陆智勇;隋翔宇;王香凝;唐兆云;江润峰 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11524 | 分类号: | H01L27/11524;H01L27/11526;H01L27/11551;H01L27/1157;H01L27/11573;H01L27/11578 |
代理公司: | 北京辰权知识产权代理有限公司 11619 | 代理人: | 郎志涛 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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摘要: | 本发明提供了防止SEG损坏的3D NAND制备方法及获得的3D NAND闪存,所述方法包括,在所述周边区域器件的制备过程中,采用低温氧化法生成周边区域栅极硬掩膜氧化物并在衬底背面形成氧化物膜层,并控制衬底背面清洗工艺,使得衬底背面的硬掩膜氧化物保留至沟通孔制备工艺;从而防止电荷产生,防止磷酸刻蚀过程中发生电化学反应而对SEG造成损坏。进而可以防止3D结构的崩塌,并且降低BSG失效率;获得更高的产品收得率。 | ||
搜索关键词: | 防止 seg 损坏 dnand 制备 方法 获得 闪存 | ||
【主权项】:
1.防止SEG损坏的3D NAND制备方法,其特征在于,所述方法包括如下制备步骤:提供一个Si衬底;在衬底上进行周边区域器件的制备;在所述周边区域器件的制备过程中,采用低温氧化法生成周边区域栅极硬掩膜氧化物并在衬底背面形成氧化物膜层,并控制衬底背面清洗工艺,使得衬底背面的硬掩膜氧化物保留至沟通孔制备工艺;核心区域台阶堆叠结构的制备;所述核心区域台阶堆叠结构包括多层交错堆叠的层间介质层及牺牲介质层形成衬底堆叠结构,所述牺牲介质层形成于相邻的层间介质层之间;核心区域沟道孔的制备;所述沟道孔包括硅外延生长层(SEG),以及在该硅外延生长层上的堆叠结构;核心区域栅极线槽的制备;利用栅极线槽通过磷酸(H3PO4)刻蚀去除堆叠结构中的牺牲介质层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
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