[发明专利]半导体结构及其形成方法有效
申请号: | 201710881845.X | 申请日: | 2017-09-26 |
公开(公告)号: | CN109560046B | 公开(公告)日: | 2020-12-22 |
发明(设计)人: | 邓武锋 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路新技术研发(上海)有限公司 |
主分类号: | H01L21/8238 | 分类号: | H01L21/8238;H01L27/092 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 徐文欣;吴敏 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 一种半导体结构及其形成方法,方法包括:基底,基底包括第三区和第三区两侧第一区和第二区,基底上具有伪栅极膜和掩膜材料层;去除第一区和部分第三区掩膜材料层,在第一区形成第一掩膜层;以第一掩膜层为掩膜,在第一区形成第一伪栅极层;去除第二区和部分第三区掩膜材料层,在第二区形成第二掩膜层,在第三区形成第三掩膜层,第三掩膜层最大厚度大于第一掩膜层或第二掩膜层厚度;以第二掩膜层为掩膜,在第二区形成第二伪栅极层;在基底上形成第一初始介质膜,第一初始介质膜暴露出第三掩膜层;采用第一刻蚀去除部分第一初始介质膜,暴露出第一掩膜层和第二掩膜层顶部;采用第二刻蚀去除第一掩膜层、第二掩膜层和第三掩膜层。所形成器件性能好。 | ||
搜索关键词: | 半导体 结构 及其 形成 方法 | ||
【主权项】:
1.一种半导体结构的形成方法,其特征在于,包括:提供基底,所述基底包括第三区和位于第三区两侧的第一区和第二区,所述基底上具有由第一区延伸至第二区的伪栅极膜和位于伪栅极膜上的掩膜材料层;采用第一图形化工艺去除所述第一区和部分第三区的掩膜材料层,在第一区形成若干第一掩膜层;以所述第一掩膜层为掩膜,刻蚀第一区伪栅极膜,直至暴露出基底,形成若干第一伪栅极层;在第一图形化工艺之后,采用第二图形化工艺,去除所述第二区和部分第三区的掩膜材料层,在第二区基底上形成若干第二掩膜层,在第三区基底上形成第三掩膜层,所述第三掩膜层的最大厚度大于第一掩膜层或第二掩膜层的厚度;以所述第二掩膜层为掩膜,刻蚀第二区伪栅极膜,直至暴露出基底,形成若干第二伪栅极层;在所述基底上、第一伪栅极层和第二伪栅极层的侧壁、第一掩膜层的侧壁和顶部表面、以及第二掩膜层的侧壁和顶部表面形成第一初始介质膜,所述第一初始介质膜暴露出第三掩膜层;采用第一刻蚀工艺去除部分第一初始介质膜,直至暴露出第一掩膜层和第二掩膜层顶部,形成第一介质膜;所述第一刻蚀工艺之后,采用第二刻蚀工艺去除第一掩膜层、第二掩膜层和第三掩膜层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造