[发明专利]高深宽比结构、电容器结构、半导体存储器件及制备方法在审
申请号: | 201711022724.6 | 申请日: | 2017-10-27 |
公开(公告)号: | CN107706181A | 公开(公告)日: | 2018-02-16 |
发明(设计)人: | 不公告发明人 | 申请(专利权)人: | 睿力集成电路有限公司 |
主分类号: | H01L27/108 | 分类号: | H01L27/108;H01L21/8242;H01L49/02 |
代理公司: | 上海光华专利事务所(普通合伙)31219 | 代理人: | 余明伟 |
地址: | 230000 安徽省合肥市*** | 国省代码: | 安徽;34 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 本发明提供一高深宽比结构的制备方法,制备方法包括提供一带有绝缘层的衬底,并于绝缘层中形成复数个贯通其上下表面下接触点;于绝缘层及下接触点的上表面形成交替叠置的支撑层和介质层,并对支撑层和介质层进行刻蚀,以形成原始孔,原始孔的顶部宽度大于其底部宽度;于支撑层的上表面及原始孔的上部侧壁表面形成阻挡层;对原始孔的下部侧壁进行外形修饰以形成暴露出下接触点的通孔,通孔的底部宽度不小于其顶部宽度,通孔的顶部宽度相同于原始孔的顶部宽度;去除阻挡层。本发明解决了采用现有方法制备柱状电容器时,因下接触点面积变小,导致柱状电容器与下接触点之间的电阻阻抗变高,及造成刻蚀不足,使柱状电容器与下接触点发生断路的问题。 | ||
搜索关键词: | 高深 结构 电容器 半导体 存储 器件 制备 方法 | ||
【主权项】:
一种高深宽比结构的制备方法,其特征在于,所述制备方法包括:步骤1)提供一上表面形成有绝缘层的衬底,并于所述绝缘层中形成复数个下接触点,所述下接触点贯通所述绝缘层的上表面及下表面;步骤2)于所述绝缘层及所述下接触点的上表面形成交替叠置的支撑层和介质层,并对所述支撑层和所述介质层进行刻蚀,以形成原始孔,其中,所述原始孔的顶部宽度大于所述原始孔的底部宽度;步骤3)于所述支撑层的上表面及所述原始孔的上部侧壁表面形成阻挡层;步骤4)对所述原始孔的下部侧壁进行外形修饰,以形成通孔,所述通孔暴露出所述下接触点,其中,所述通孔的底部宽度不小于所述通孔的顶部宽度,所述通孔的顶部宽度相同于所述原始孔的顶部宽度;以及步骤5)去除所述阻挡层,以形成高深宽比结构。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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